湖南大学数字电路与逻辑设计总结-北京尧图网络

这门课学得有点杂学完的整体映象是数字电路逻辑电路计算机组成。作业10%课堂测试5%最后是赋分制所以差距不会很大。实验8%第一个实验是电子秤后续实验都是实验模型机的部分组件需要提交平台自动测试多次提交好像会扣点分不过最终也不知道实验具体是咋算的。小班8.57%每次随机抽人讲解小测6.42%几乎不可能人力在时间内做完要提前做好准备最终得分会开平方再计入成绩。Midterm Exam (15%, final score 99): The question types are basically the same as those in the quizzes and assignments. If you understand the quizzes and assignments well, it shouldnt be a problem.期末35%最终得分99题型变化较大往届参考意义不大复习的话推荐考前几节课认真听基于小班小测作业复习题型知识点几乎全部出自这里面课件为辅。综合设计12%自主设计一个模型机具体各个部件在前面的实验都已经实现了最后只需要把各个部分连起来就行了。2、课堂测试占总评成绩 5%高于 0 分的同学课堂测试成绩赋分后课堂测试成绩 - 缺交次数 × 1缺勤 6 次及以上扣 10 分3、课后作业占总评成绩 10%高于 0 分的同学课后作业成绩赋分后课后作业成绩 - 缺交次数 × 14、小测讨论15 分每次小测成绩小测成绩开平方根 × 10此项成绩小测平均成绩 × 3/7 讨论平均成绩 × 4/75、实验8 分三次实验成绩平均每次实验成绩评测 × 50% 报告 × 50%6、综合设计12 分验收成绩基础版验收成绩百分制× 80% 下板加分满分 5 分扩展加分综合设计成绩验收成绩 × 70% 报告成绩百分制× 30%7、平时成绩一30分课堂测试 × 1/6 课后作业 × 1/3 讨论小测 × 1/2平时成绩二20 分实验 × 40% 综合设计 × 60%期中成绩15 分期末成绩35 分8、总评成绩平时成绩一 × 30% 平时成绩二 × 20% 期中成绩 × 15% 期末成绩 × 35%

湖南大学数字电路与逻辑设计总结

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