MIPI HS RX链路调试实战：从D-PHY原理到RK3588适配st7701s屏幕-北京尧图网络

直接从正文开始。我调试MIPI屏幕的坑已经踩过不少了这次趁着一块st7701s面板的适配机会把MIPI HS RX这条链路从头到脚捋了一遍。写这篇东西的目的很简单如果你跟我一样手里拿着FPGA开发板或者RK3588这类主控要接一块MIPI DSI或D-PHY接口的屏幕又或者纯属想搞明白HS RX到底是什么、怎么调、怎么排查问题那这篇文章应该能帮你省下不少折腾时间。先说明白MIPI HS RX不是一个单独的芯片也不存在买一颗RX就能用的说法。它是MIPI D-PHY物理层里一个接收方向的高速模块负责把对面TX送过来的差分高速串行数据转成SoC或FPGA内部能理解的并行像素字节流。无论是RK3588的MIPI DSI控制器还是FPGA里自己写的D-PHY接收逻辑都绕不开这个模块。文章会从物理层、电气参数、校准机制、实际调试几个层面掰开讲最后配上我这次调st7701s的实际流程和几个典型故障排查思路。内容偏实战但每个关键点我都会把原理讲清楚免得你只会改寄存器出了问题完全没方向。1. HS RX到底接了什么从物理层到协议层的完整链路拆解1.1 高速模式下RX一侧经历的完整信号链路很多刚开始接触MIPI的人容易把HS RX想得太简单以为就是一对差分线进来接到某个引脚上数据就自动进去了。实际完全不是这么回事。MIPI D-PHY的物理链路里TX和RX之间走的是串行数据但协议上分了两层物理层PHY负责电信号收发、时钟恢复、lane对齐协议层DSI/CSI-2负责字节打包、包头解析、ECC校验、像素格式转换。HS RX在整个链路里所处的位置大概可以这样理解屏幕模组或者摄像头传感器是数据源它们内置了HS TX主控这边是数据接收方内置HS RX。TX把并行像素数据经过Serializer转成高速串行比特流通过一对差分线发出来RX这边先用Receiver电路感知差分信号再通过CDR时钟数据恢复重新提取出采样时钟最后把串行比特流重新拼成字节交给控制器或协议引擎去做解析。这里有一个很关键的概念就是数据并不是一个lane一辆车排队进停车场而是多个lane并行发。DSI规范里常见的配置是1个时钟lane加1~4个数据lane比如我们常见的4 lane MIPI DSI其实就是5对差分线2根时钟线加8根数据线这些lane必须同步工作。RX端接收到的数据并不是天然对齐的每个lane上的bit流有独立的传播延迟这就引出后面要详细说的deskew校准问题。先把链路结构记住差分输入→终端匹配→均衡放大→CDR时钟恢复→串并转换→lane对齐→字节打包→协议引擎解析。这就是HS RX的全部工作。1.2 规范版本差异选择接收端IP时的几个硬指标MIPI D-PHY规范经过了多个版本迭代D-PHY v1.0、v1.1、v1.2再到后来的v2.0不同版本对HS RX的速率要求差异很大。这里必须说清楚很多人在FPGA里写D-PHY接收模块查资料的时候被各种支持1.5Gbps/lane支持2.5Gbps/lane的说法搞晕其实这些数字对应的物理层实现难度完全不同。绝大多数手机屏幕、嵌入式屏幕比如常见的1080P 60帧MIPI DSI屏实际需要的HS速率在800Mbps~1.2Gbps每lane这个区间。RGBA8888格式、1080P60fps、4 lane的配置下总数据量大概在1.3Gbps左右分摊到每个lane大约350Mbps但考虑到blanking开销、帧头帧尾、DSI包格式的开销实际HS速率通常跑到700Mbps~1Gbps每lane。这个速率下用FPGA的普通IO加上外部终端电阻就能比较稳妥地接收。但如果你要接的是1080P120Hz或者2K/4K高刷屏情况就不一样了。单lane速率很可能突破1.5Gbps到了这个级别FPGA内部的serdes、RX端均衡和CDR的要求就非常苛刻了。D-PHY v2.0已经把HS速率上限从v1.2的2.5Gbps提高到4.5Gbps每lane不过实际用DSI的场景很少跑到这个数。选型的时候第一个要看的就是你的屏或者sensor的HS速率需求决定了你的接收端硬件能力和设计复杂度这是所有后续调试的前提比什么都重要。表格对比一下我自己常用的几个配置等级应用场景典型分辨率/刷新率Lane数单lane HS速率接收端硬件要求低端串口屏/小尺寸LCD480x800 60fps1~2 lane200~400Mbps普通MCU或FPGA低速IO可应付主流手机屏/平板1080P 60fps2~4 lane700Mbps~1Gbps需要专用PHY或FPGA内部serdes高刷屏/2K屏1080P120Hz或2K60fps4 lane1.2Gbps~1.5Gbps必须使用硬核MIPI D-PHY高端4K屏4K60fps4~8 lane1.5Gbps~2.5Gbps专用桥接芯片或旗舰SoC硬核你看到没有同样是MIPI屏幕速率需求差别非常大。这就是为什么一台便宜的MIPI驱动板只能点亮小分辨率屏换个大屏就全是雪花点——多半就是HS RX链路根本跑不动那么高的速率。2. 差分对上的电压摆幅与终端匹配先看电气规格再谈调试2.1 HS信号电气特征不是数字逻辑而是模拟电路问题这句话值得反复强调。HS RX跟TTL串口、GPIO按键那些纯数字电路完全是两码事。HS信号在传输线上是差分电压不是单端的高电平低电平。D-PHY规范里对HS信号有明确的电气定义HS-TX在转入高速模式后差分电压摆幅典型值是200mV100mV~300mV范围共模电压大概在100mV~300mV之间。也就是说单根线上看起来电压一直在1.2V附近晃真正传达信息的是两根线之间那微小的电压差。很多人第一次用示波器看MIPI信号会以为信号有问题怎么幅度那么小其实这是正常的。这时候如果接收端的终端匹配电阻搞错或者RC补偿网络不对波形就会严重变形。RX端必须在差分对尽头放一个100Ω的终端电阻这个电阻在高速信号链路上扮演的角色是消除反射。如果不接终端电阻、或者阻值偏差大信号到达RX芯片后会在接收端反射回去跟后续到达的信号叠加形成振铃。你在示波器上看到的眼图就会一团糊RX恢复出的数据就全是误码。我自己第一次画MIPI转接板的时候就吃过这个亏100Ω电阻位置放偏了两个毫米走了好几根过孔结果眼图闭合得厉害调了好几天才查出来是阻抗不连续导致的反射问题。后面我画板子的时候MIPI差分对全都走顶层无过孔、等长控制、在内层做完整的参考地平面终端电阻放在紧挨接收端引脚的位置走线长度尽量控制在5mm以内。这块不用省直接影响HS RX能不能收到干干净净的信号。2.2 终端电阻、共模电压与实际波形判读说到波形判读这里必须分享一个我自己的习惯先用示波器看HS信号。注意普通示波器探头带宽不够看1Gbps以上的MIPI信号基本等于看马赛克。如果你只有普通示波器退而求其次至少在接收端测试点用差分探头或者高带宽单端探头去测单端波形确认包络、幅值有没有明显异常。HS-RX正常工作时波形应该是一个幅度在100~300mV的振荡包络你看到的是一个中间有个缝隙的差分信号两块高电平区域之间夹着HS数据毛刺。在进入HS前和退出HS后链路处于LP低功耗状态这时候波形是大幅值的单端逻辑电平接近0V和1.2V跳变中间有明显的LP传输间隔。看波形的时候特别注意一个细节HS burst开始和结束的位置有没有过冲、振铃。如果HS数据区前后的LP信号边上出现了明显的负过冲尖峰大概率是终端匹配或者源端驱动强度的问题。D-PHY驱动器的驱动强度是可调的在SoC的PHY配置寄存器或者FPGA的约束文件里往往有这个参数要根据PCB布线长度和阻抗来调整。这个我后面会再提一句属于是那种没调过的人永远不知道的隐性问题。2.3 高速布线层面容易忽略的等长与阻抗MIPI HS RX能不能工作有时候从PCB布局阶段就已经注定了。差分对自身要等长比如P和N两根线之间的长度差要控制到mil级5mil以内比较稳。同一组lane之间也就是clk lane和各个data lane之间也要等长。D-PHY规范对lane间skew有明确上限通常是1UI以下一个数据位的时间宽度在1Gbps下就是1纳秒以内的偏差。换算成PCB走线长度大概150mm正常不会超但你要是走线乱七八糟、大量打过孔问题一下就出来了。这里有一个更隐蔽的点差分对参考平面的连续性。如果差分对跨过分割槽或者一边有地平面另一边没有回流路径会被拉长信号质量急剧劣化。我见过有人为了绕开某个芯片把MIPI走线绕了一个大弯结果眼图直接塌了。建议是MIPI走线区域正下方保持完整的参考地两边不要有干扰源跟I2C、SPI这些信号拉开至少3倍线宽的距离。那如果你跟我一样用FPGA来做MIPI RX还有一个额外要考虑的点引脚分配。FPGA内部的serdes模块比如Xilinx的ISERDESE2、Intel的ALTLVDS_RX不是所有引脚都能用必须选择支持差分IO标准的bank并且要保持P-N配对、同一对差分线要放在相邻引脚上。这个引脚选型做错了后面积压的信号时序根本修不回来只能重画板子重打样。别问我怎么知道的。3. Deskew校准与lane对齐花屏问题最常见的元凶3.1 为什么同一时刻从不同lane到达的数据会错位这个问题在MIPI接收调试里太常见了。你接线没错、速率也算得对、电源也干净但屏幕上就是不正常——要么整体偏移要么出现彩色条纹要么左半块显示右半块的内容。这时候八成跟deskew有关。解释一下deskew的必要性。MIPI DSI支持1~4个数据lane数据是分摊到各个lane上同步传输的。发送端像素数据经过分lane逻辑把数据字节打散到各个lane上同时保证各个lane的传输起始点是同步的。但到达接收端的时候由于物理走线长度差异、过孔、连接器阻抗差异各lane的实际传播延迟并不一样。接收端恢复出来的数据进行并行拼接前必须先做对齐。这个对齐动作就是deskew。D-PHY协议在HS数据传输正式开始前会有一段固定模式的训练序列一般叫做LP→HS切换的同步序列。TX端进入HS模式前会先发一个SoTStart of Transmission序列这个序列包含一段连续的前导RX端通过检测这个前导来锁定各lane的采样窗口。实际的数据包投递沿包内的数据对齐还要靠更精细的校准这就是deskew calibration。3.2 Deskew校准序列长什么样RX要做什么DSI协议里的deskew校准序列一般是HS传输开始后紧跟着的一段特定模式数据RX通过接收并比对这段模式来调整各数据lane的延迟。校准序列具体结构在D-PHY规范里有定义常见的就是包含多个0xD6、0x4B这样的特殊字节或者重复发送特定pattern。RX端要做的事情简单概括就是接收校准序列的同时用内部延迟链逐lane调节采样点直到所有lane上解析出的字节一致。这里有个很现实的问题不是每个SoC或FPGA IP都自动做deskew校准。部分桥接芯片和硬核MIPI PHY会在初始化阶段自动完成但你要是自己用FPGA的普通IO搭的RX或者用的老型号的桥接芯片很可能需要软件参与手动调整寄存器里的per-lane delay值。RK3588这类平台驱动里会有对应的clock lane和数据lane的相位微调参数Android或Linux下调试MIPI屏如果你发现画面有规律的偏移去翻dts里面的lane-polarities和deskew相关参数是对的。我之前调一块国产屏幕的时候画面整体向右偏移了大约一个字符的宽度其实就是数据lane和时钟lane对齐出了偏差。后来在驱动里把data lane的延迟整体往高调了几个寄存器单位问题直接消失。这块的技术特征可以说很清晰了偏移是固定量、不是随机多半是固定skew靠手动对齐就能解决。如果偏移量随机变化、每次开机不一样那就是校准机制没有生效问题会更严重要去查RX端的自动校准逻辑有没有跑起来。3.3 软件兼容层RK3588与FPGA里如何低成本完成校准RK3588跑Linux或AndroidMIPI DSI屏的适配重点不在硬件在dts配置。设备树里除了选好compatible、pinmux和regulator还要关注panel timing参数。hsync、vsync、hfp、hbp这些时序如果配错不同lane的采样偏移就会被放大屏幕显示错位。在RK3588的DW-MIPI-DSI驱动里几个关键属性是data-lanes、clock-lanes、lane-polarities以及与PHY相关的phy-mode。把data-lanes写对是最基础的检查项我之前接过一块屏板子画的是4 lane但dts里只写了2 lane剩下两个lane悬空结果是开机能亮画面色彩明显偏色类似每两个像素丢一个的效果。这种问题排查起来很费神因为你看接线是4 lane硬件上都有但驱动解析出来只有2 lane。建议入门的人拿到一块新屏第一件事就是数清楚模组FPC上的lane数量跟dts对齐。FPGA方案里做deskew校准最常见的低成本做法是用发送端固定发送校准pattern接收端用移位寄存器把各lane数据缓存起来然后逐位扫描查找对齐点。在低速200~500Mbps场景下这个思路非常管用代码量不大也不一定需要专门的D-PHY IP。Xilinx的7系列FPGA里可以拿ISERDESE2接差分引脚搭配IDELAYE2做精细延迟调整。IDELAYE2的分辨率大概在几十皮秒到上百皮秒的量级1Gbps下的1UI是1ns用IDELAYE2去校准不是不可能但需要注意延迟精度和环境温度漂移——校准做完之后环境一变延迟偏差又回来了。所以工业级产品里很少用纯IO加IDELAY去接高速MIPI集成硬核PHY才是正途。4. 实战从st7701s到RK3588的MIPI屏幕适配过程4.1 st7701s屏幕接入RK3588的配置链路st7701s是一颗非常常见的MIPI DSI转LCD驱动IC很多国产小尺寸屏模组都在用它分辨率通常从480x800到720x1280接口就是标准的MIPI DSI。RK3588这颗SoC自带多个MIPI DSI控制器输出能力很充裕配合st7701s这类模组驱动芯片点亮屏幕的逻辑链路是RK3588的视频处理器产生像素数据→内部DSC/DSI控制器打包成MIPI DSI包→PHY转换成HS信号发出→面板端的st7701s接收并驱动LCD玻璃刷新。适配的第一步不是写代码是对参数。要拿到屏的datasheet或模组厂给的初始化序列。st7701s的初始化序列通常是一长串MIPI DSI write命令里面设置GIP时序、Gamma曲线、像素格式、偏压等等。这些初始化命令的作用是把st7701s内部的寄存器状态调到跟模组玻璃和背光电源要求完全匹配的状态。我反复吃过亏拿兼容型号的初始化序列直接怼上去刚开始看似亮了但显示不均匀、对比度不对、极性错乱折腾一圈下来发现还是初始化寄存器没配对。RK3588适配MIPI屏幕通常走两条路一是内核里用标准的panel driver框架比如panel-simple在设备树里提供时序参数和初始化命令序列二是用vendor提供的专用驱动。我推荐第一条路因为代码结构清楚、容易调试。即使后面要加上背光控制、电源时序也是在设备树里改的事不需要动内核代码。4.2 从寄存器到屏幕点亮一条完整的数据通路这里我完整记录一下我点st7701s屏的实际步骤。先说平台RK3588跑Linux 5.10内核。开发板是通用的RK3588 EVB屏是7寸720x12804 lane DSIst7701s驱动。第一步确认硬件连接和供电。MIPI DSI的供电分两个层面主控侧IO电源1.2V/1.8V面板侧模拟电源IOVCC通常1.8V或3.3V、VCI2.8V或3.3V、VDDB背光LED供电。上电顺序很讲究一般是先VCI再IOVCC然后等主控发MIPI信号最后再打开背光。顺序反了或者电压范围不对st7701s锁不住信号或者屏幕发白。第二步把设备树里的MIPI DSI节点配好包括route、encoder、panel。RK3588的dts里MIPI DSI通常挂在一个display-subsystem下面你需要为这个屏单独建一个panel节点把compatible定成类似panel-dsi-st7701这种自定义的然后在驱动里注册。第三步写panel的初始化序列。我的习惯是把初始化序列放在panel驱动里用一个数组保存在panel_prepare()阶段通过MIPI DSI发送。st7701s的初始化序列前面通常有解除密码锁的Command比如0xFF 0xEE 0x01这种厂商解锁指令然后依次设置STP、GIP、Gamma、Power等等。这些命令是模组厂提供的复制的时候要小心字节顺序MIPI DSI传输支持DCS长短包短包就是2字节命令2字节数据长包通常是0x06DCS写。每个寄存器都值得仔细校对因为你不知道哪一条是决定这块屏能不能锁住HS数据的。第四步调timing。mipi dsi panel在设备树里要设display-timings。st7701s屏常见参数是Hactive 720、Vactive 1280HFP HBP VFP VBP这些要跟模组spec一致。timing不对外设参与HS RX本身但它会影响DSI控制器发数据包的节奏跟FIFO水位和帧率挂钩。我调试的时候一般先开宽松的时序比如把HFP调大、VFP调大让屏幕亮起来再逐步压缩。屏幕亮了但如果出现刷新闪跳往往就是blanking参数太紧了DSI Controller的发送带宽被用完RX侧出现了underrun。4.3 FPGA实现MIPI RX的典型方案如果你不是用SoC而是要用FPGA实现MIPI RX那完全是另一套打法。FPGA里做MIPI RX有三种层次低端做法是买一颗MIPI转并行RGB/LVDS的桥接芯片如TC358746、LT8912这类FPGA只做并行端接收中端做法是FPGA内部起LVDS IO用内置的serdes模块接MIPI信号但要自己在FPGA里做RX逻辑高端做法是FPGA芯片内置了硬核MIPI D-PHY比如Xilinx的MIPI CSI-2/DSI subsystem IP可以直接用。自己用FPGA普通IO收MIPI HS信号最容易掉进去的坑是物理层。核心问题是MIPI HS RX需要有CDR时钟数据恢复能力因为MIPI DSI总线上数据信号和时钟信号是分开的正常情况下时钟lane带着时钟走数据lane跟着时钟采样。如果你的FPGA没有硬核PHY只在逻辑里实现RX你需要的是用外部时钟恢复数据的思路其实不少开发板是这么干的SYNC电路检测SoT序列的start位然后从数据流的翻转沿里恢复出采样窗口。我自己在Xilinx 7系列上做过一次演示级的MIPI RX接收摄像头数据用的方案是IDELAYISERDESE2FPGA逻辑。时钟lane进来之后接到BUFG上作为全局时钟数据lane经过IDELAYE2后进入ISERDESE2然后在逻辑里锁定lane对齐。这个方案的问题在于ISERDESE2是DDR采样它依赖外部时钟作为位时钟。MIPI DSI的时钟lane在HS模式下是一个持续翻转的时钟信号可以直接用但DDR采样要求数据时钟频率足够、占空比稳定一旦前面PCB布线引入的延迟超出一定范围问题会成倍放大。所以FPGA方案我的建议是能用桥接芯片就尽量用桥接芯片除非你纯粹为了学习想自己写逻辑探一探MIPI的底。5. 调试MIPI HS RX最容易翻车的三个场景5.1 场景一上电稳定后读不到面板ID屏幕模组往往带一个I2C接口用来读ID或写配置。很多人第一步就去读这个ID结果发现读不到。排查思路不要只盯I2C本身先想过一个链路I2C地址对不对、屏的I2C电源有没有开、主控的I2C总线有没有被占用。但还有个大坑MIPI DSI控制器还没初始化好的时候模组的I2C接口可能是关闭的因为有些模组要等MIPI接口完成一次握手内部MCU才起来I2C才响应。所以正确顺序是先完成DPHY初始化尤其要先完成HS时钟建立再读I2C。我在st7701s上遇到过一次MIPI信号没起来I2C地址确认正确、电源也对但I2C总线上永远是NAK。后来用示波器看了MIPI差分对发现时钟lane一直处于LP状态没有HS翻转说明DSI控制器压根没有启动。把驱动的enable顺序调对让DSI先出HS时钟I2C立刻就能读到ID了。这个问题跟HS RX关联非常大因为模组内部的RX端是靠检测到时钟lane的HS信号才完成握手唤醒的时钟不出来一切都是空中楼阁。5.2 场景二画面撕裂、横条纹、雪花点屏幕上出现雪花点或横向彩色条纹优先怀疑链路层的误码。SDR单端信号还好排查但MIPI HS RX的误码原因排查看起来是大海捞针。常规排查顺序一是看HS信号眼图。用高带宽示波器在时钟lane、数据lane上分别看HS burst期间的眼图观察有没有明显的过冲、振铃、电平塌陷。如果眼图又瘦又歪优先怀疑电源噪声和终端匹配其次怀疑走线阻抗。这里是模拟问题的集大成区很多时候是主控侧PHY的驱动强度太强或太弱导致。RK3588可以在设备树或驱动里调整PHY的drive strength我曾经遇到过驱动强度太强导致过冲严重降低一档后眼图立刻变好。二是检查时钟lane的占空比。MIPI时钟lane在HS期间是一个高频连续翻转方波占空比应当接近50%。如果占空比偏差大数据采样窗口就会被压缩引起偶发误码。这种问题往往是时钟恢复模块或PHY内部分频设置的毛病。三是看HS burst之间的间隔确保每个lane都正确收到了EoTEnd of Transmission信号。如果EoT没收到接收端会一直等待可能表现为屏幕全黑或者闪烁。四是panel的初始化命令本身有问题。比如st7701s的某个命令设置错了导致内部时钟分频不对也有可能出现雪花点。这种问题最好用示波器定位还是在signal上确认数据链路没问题之后再去怀疑驱动代码。5.3 场景三热插拔或长时间运行后偶发花屏这类偶发性问题最头疼。长时间运行后偶发花屏大概率是链路margin不够。MIPI HS RX的数字采样窗口如果余量不足环境温度一变化管脚延迟和供电都随之漂移就可能在某个临界点触发误码。我用过一个排查手段在面板驱动里打开自检模式让屏幕刷纯色或特定pattern然后用脚本长时间监控。如果出现花屏立刻抓显示错误标志。很多高通的DSI控制器里都有error irq记录比如ECC error、CRC error、overflow等。RK3588的DW-MIPI-DSI控制器也有类似的中断状态寄存器能看到CRC/ECC报错。这类信号一旦出现就说明RX侧确实收到了错误数据不是逻辑侧的问题。定位到是HS RX链路问题后解决思路是增加margin。能做的事情包括降低HS速率比如从1Gbps降到900Mbps提高PHY驱动强度优化供电去耦调整deskew延迟。还有一个经常被忽略的点MIPI DSI走线的连接器处FPC排线有没有固定好松动的FPC简直是MIPI信号质量的噩梦。我见过有人排查了一周最后发现是FPC连接器虚焊。6. 几个关于HS RX的常见认知误区6.1 MIPI RX不就是一个LVDS接收器吗——错LVDS和MIPI D-PHY虽然都是差分串行但区别大得远。LVDS一般是固定频率、固定的并行位宽接收端只用恢复数据、不涉及复杂的协议解析。MIPI D-PHY除了HS模式还有LP模式两条线上电压状态有4种数据lane和时钟lane各有分工DPHY还有前导码、SoT、EoT、BTA总线转向这些协议状态机。接收端要处理的远不止是bit恢复。如果你的方案里想用现成的LVDS RX IP去接MIPI省省吧协议层这一关就过不去。6.2 屏幕点不亮就要改初始化命令——不一定有人拿到新屏点不亮就死磕初始化序列一遍遍改寄存器完全忽略物理层和链路层的排查。我的经验是真正的驱动IC初始化问题占比其实不高大多数点不亮是电源时序不对、PHY没起来、dts lane数/极性配置错、时钟lane没输出HS信号。初始化命令就算全不执行屏幕上至少应该能看到背光亮、有画面轮廓或者至少能测到MIPI信号线上有活动。如果信号线上静悄悄不要改初始化命令先回头查链路。6.3 RK3588适配MIPI屏只要改dts就行——也要有场景意识dts当然重要但只能解决配置层问题。如果PCB走线不行信号质量本身差dts改再精细也白搭。我自己调板子的时候dts这块占的调试时间大概只有三成剩下七成都在物理层和信号完整性上。所以如果有人只让你改dts点屏你要多留一个心眼——他可能忽略了一个事实任何软件配置都救不了物理层的硬伤。7. 写在最后的调试习惯调试MIPI HS RX这么久最深的体会是先用示波器确认信号再去读满屏的寄存器。信号在、时序对、电气正常屏幕上才可能出现可调试的画面。如果信号根本没有那驱动代码写得再完美也只是空中楼阁。反过来当信号链路的波形、眼图都正常屏幕还是花的才建议深入软件侧逐条排查初始化序列和dts参数。这个先后顺序能帮你省下无数个瞎改配置的夜晚。另外一个实用习惯是准备一个最小点亮配置单独一个纯色画面、一条最简单的初始化序列、宽松的时序。这样一旦点不亮你面对的不再是一堆复杂的参数而是一个最简单的基准环境。先把最简单的搞亮再逐步往上加东西哪一步加了之后坏了问题就在哪一步。这个思路帮我解决过至少三次难缠的MIPI屏适配故障也一并分享给你。

MIPI HS RX链路调试实战：从D-PHY原理到RK3588适配st7701s屏幕

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