24C256 EEPROM页写边界、地址回卷与I2C时序实践-北京尧图网络

简介围绕24C256存储器使用整理的这份中文资料面向单片机开发初学者及需要调试I2C EEPROM的工程师重点讲清容量与16位地址划分、页内/页地址关系、连续写跨页覆盖等易错点并给出MSP430F449平台下IIC延时、启动停止、发送0/1、读写字符与应答检测等基本控制模块。资源包仅含1个doc文件约33KB篇幅集中适合作为24C256地址管理与底层时序的速查笔记。已有1916人学习下载说明其在实际项目排错中具有一定参考价值。读者可据此理解32768字节存储空间的组织方式掌握连续存储时按64、32、16、8、4、2对齐及不足补零的处理思路减少跨页写入导致的数据覆盖问题并对照代码模块梳理I2C通信的起停、收发与ACK流程。1. 24C256 的 32768 字节不是一块连续画布先认清 15 位地址模型去年帮人调一块采集板30 字节一帧的数据写进 24C256前两帧读出来完全正确第三帧开始整体错位现场一度以为是电源纹波在捣乱。最后把写入地址打印出来才看明白不是器件坏了是地址模型没吃透。24C256 是 I2C 接口、512 页 × 64 字节的 EEPROM有效容量 32768 字节总线协议却给了 16 位地址其中只有低 15 位真正参与译码低 6 位是页内偏移063中间 9 位是页号0511。它形式上是一段连续地址物理上却是 512 个互不相通的 64 字节格子。谁在写裸机位操作 I2C、谁从 24C02 那种单字节地址器件迁移过来只要跨过一次页边界一样会出问题。2. 页写边界64 字节一页地址回卷是怎么吃掉数据的24C256 最反直觉的地方在于连续写模式下器件内部的地址计数器只递增低 6 位溢出后不向页号进位而是回到本页 0 地址重新开始。总线上的地址看起来仍然在往前走落盘位置却已经绕回去了。所以「地址每次加 N、看上去很整齐」这件事完全不能保证数据不互相覆盖。2.1 从 63 到 64 的那一步到底发生了什么把地址拆成二进制看最清楚。63 是0b0000_0000_0011_111164 是0b0000_0000_0100_0000。63 的低 6 位全为 1表示第 0 页最后一个字节64 的低 6 位归零、页号位加一表示第 1 页第一个字节。在被动写入路径上这两个地址是两套完全不同的页选择但在器件内部的连续写状态机里它只认低 6 位这个 063 的指针。假设你从地址 0x003F 开始连续发两个字节第一个字节落在 0x003F指针加一变 64越过 6 位边界后回卷成 0第二个字节直接写到 0x0000。你原本以为它写到 0x0040结果它把第 0 页开头的数据覆盖了而且写完之后读 0x0040 依然是旧值读 0x0000 却是新值。这种错位最难查因为读回的每一帧单看都合法只有把整片 dump 出来对比地址才发现错位。原文举的 11 字节步进是个更隐蔽的例子。地址序列是 0、11、22、33、44、55看着每次加 11 毫无问题。但 55 这一块只有 5563 共 9 个字节空间第 10 和第 11 个字节回卷到 0x00 和 0x01正好把第一块的前两字节冲掉。也就是说前五块写得好好的第六块一落笔历史数据就没了。这是典型的「错误延迟暴露」写入动作本身没错错在它破坏了更早的正确数据。注意页回卷只发生在写路径。读路径的地址计数器是 15 位全宽递增的可以一路从 0 读到 0x7FFF 再绕回 0不会在 64 字节边界打转。很多人口口相传「读写都要按页切」其实是把写的限制错安到读头上白白把一次连续读拆成几十次事务。2.2 块大小只取 64/32/16/8把 30 字节按 32 存尾部补零解决办法不复杂核心是把「逻辑记录」映射到「页对齐槽位」。如果一帧有效数据是 30 字节就在存储层把它塞进 32 字节的槽多余的 2 字节补零。槽大小必须取 2 的幂且不大于 64这样任意第 index 个槽的起始地址天然满足index × 32 % 32 0永远不会骑在页边界上。原文给的建议是 64、32、16、8、4、2这几个数不是随便挑的只有 2 的幂才能在 64 以内整除保证第 N 块的起点对齐到块大小第 N1 块才不会从半页中间开始。像 11 这种非 2 的幂步进无论从哪个地址起步迟早会撞上页尾。槽大小单页可放槽数起始地址约束30 字节帧的实际占用每帧浪费641addr % 64 064 字节34 字节322addr % 32 032 字节2 字节164addr % 16 032 字节两槽2 字节88addr % 8 032 字节四槽2 字节164无30 字节0 字节从表里能看出取舍槽越大跨页风险越小、地址计算越简单但空间浪费越多槽越小越省空间可事务次数上去了一帧要拆成好几次写每次都要等写周期吞吐直接掉下来。我的习惯是取「不小于有效长度且不大于 64 的最小 2 的幂」30 字节就取 32既省空间又只写一次。#define PAGE_SIZE 64u #define FRAME_LEN 30u #define SLOT_SIZE 32u /* 必须是 2 的幂, 且 PAGE_SIZE */ /* 把一帧有效数据装进槽位, 尾部补零 */ void pack_frame(unsigned char *slot, const unsigned char *frame) { unsigned char i; for (i 0; i SLOT_SIZE; i) /* 先整槽清零, 保证补零结果确定 */ slot[i] 0x00; for (i 0; i FRAME_LEN; i) /* 只覆盖有效部分, 尾部保持 0 */ slot[i] frame[i]; } /* 帧序号换算绝对地址, 编译期即可确定, 不需要运行时累加 */ unsigned int frame_addr(unsigned int index) { return index * SLOT_SIZE; /* SLOT_SIZE 是 2 的幂, 乘法等价于左移 */ }pack_frame里先整槽清零再填有效数据是为了让补零字节的内容确定。如果只在尾部补零而槽是从栈上来的前一次调用的残留数据会混进去做 CRC 校验时又是一场玄学。frame_addr用乘法而不是维护一个全局递增地址目的是让地址只依赖帧序号掉电重启后不会因为计数器丢失而错位。参数上唯一要盯的是上限SLOT_SIZE为 32 时最多 1024 帧index超过这个值就绕回 0 覆盖最早的数据环形日志的语义要提前想清楚。3. 位操作模拟 I2CMSP430 上五个基础原语的时序拆解手上有硬件 I2C 外设当然优先用外设但很多老设计把两个引脚分给了别的功能只能靠 GPIO 翻转模拟。原文给的 MSP430F449 版本就是这条路子P2.1 当 SDA、P2.2 当 SCL靠改方向寄存器来模拟开漏输出。这套写法在 8 位机和 16 位机上很常见坑也集中在这里。3.1 用方向寄存器模拟开漏为什么释放总线是「切输入」真正的 I2C 引脚是开漏结构只能主动拉低不能主动拉高高电平靠外部上拉电阻。普通 GPIO 是推挽的输出高就是硬顶一个高电平。如果从机此时正在拉低总线应答两边对顶轻则波形畸变重则瞬时大电流烧引脚。所以模拟 I2C 的标准做法是要拉低就把引脚配成输出、输出锁存器写 0要释放就把引脚配成输入让它变成高阻由上拉电阻把线拉回高电平。MSP430 的方向寄存器正好支持这个语义P2DIR某位置 1 是输出清 0 是输入。原文里P2DIR 0xFD是清 bit1等价于P2DIR ~0x02即把 SDA 切成输入释放P2DIR | 0x02是把 SDA 切成输出拉低。SCL 对应的 bit2 同理0xFB是清 bit20x04是置 bit2。#define SDA_BIT 0x02 /* P2.1 */ #define SCL_BIT 0x04 /* P2.2 */ /* 释放 SDA: 方向切输入, 由上拉电阻把线拉高 */ #define SDA_RELEASE() do { P2DIR ~SDA_BIT; } while (0) /* 拉低 SDA: 先把输出锁存器清 0, 再切输出 */ #define SDA_LOW() do { P2OUT ~SDA_BIT; P2DIR | SDA_BIT; } while (0) #define SCL_RELEASE() do { P2DIR ~SCL_BIT; } while (0) #define SCL_LOW() do { P2OUT ~SCL_BIT; P2DIR | SCL_BIT; } while (0)提示SDA_LOW()里那句P2OUT ~SDA_BIT不是多余动作。如果输出锁存器里残留的是 1切成输出的瞬间引脚会先顶出一个高电平与从机的下拉形成对顶波形上会出现一个几十纳秒的尖峰。短接时间极短时通常看不出来但在从机应答窗口里出现就可能被误判成 ACK 或 NACK。原文的start_IIC()里还有一句P2OUT 0xf9作用是把 P2.1、P2.2 的输出锁存预置为 0同时不影响其他位。这句和上面的宏是同一个意思只是写法更紧凑。移植到别的芯片时这一步千万不能省很多「换了个 MCU 就通信不上」的问题就出在复位后 GPIO 默认电平不同。3.2 起始位、停止位、读位与 ACK 采样窗口I2C 的五个基础动作本质上都是「SCL 处于某个电平时SDA 做一次跳变或保持」。起始位是 SCL 为高时 SDA 由高变低停止位是 SCL 为高时 SDA 由低变高数据位是 SCL 为低时改 SDA、SCL 为高时采样应答位是主机发完 8 位后释放 SDA在第 9 个时钟高电平期间读 SDA 是否为低。/* 半周期延时: 直接决定 SCL 频率, 必须按实际 MCLK 校准 */ static void iic_delay(void) { _NOP(); _NOP(); _NOP(); } void iic_start(void) { SDA_RELEASE(); SCL_RELEASE(); iic_delay(); SDA_LOW(); /* SCL 保持高, SDA 下降沿 START */ iic_delay(); SCL_LOW(); /* 占住总线, 准备发第一位 */ } void iic_stop(void) { SDA_LOW(); iic_delay(); SCL_RELEASE(); iic_delay(); SDA_RELEASE(); /* SCL 为高, SDA 上升沿 STOP */ iic_delay(); } void iic_send_byte(unsigned char dat) { unsigned char i; for (i 0; i 8; i) { if (dat 0x80) SDA_RELEASE(); else SDA_LOW(); dat 1; iic_delay(); SCL_RELEASE(); /* 从机在 SCL 高电平期间采样 */ iic_delay(); SCL_LOW(); } } unsigned char iic_read_byte(void) { unsigned char i, dat 0; SDA_RELEASE(); /* 读之前必须放开 SDA, 否则和从机对顶 */ for (i 0; i 8; i) { iic_delay(); SCL_RELEASE(); iic_delay(); dat 1; if (P2IN SDA_BIT) dat | 0x01; SCL_LOW(); } return dat; }iic_delay是整个模块里最容易被忽略、又最影响成败的参数。MSP430 的_NOP()是一个 MCLK 周期配上函数调用、返回和位操作的开销实际半周期远大于注释里写的数字。按 100kHz 总线算半周期需要 5 微秒MCLK 为 1MHz 时三个 NOP 加调用开销大约 68 微秒勉强合格一旦把 MCLK 拉到 8MHz半周期掉到 1 微秒以内SCL 频率冲到 400kHz 以上短走线或许还能跑长排线一定出问题。所以这个宏不能用#define生吞最好上示波器量一次 SCL 周期或者用一个volatile计数循环把延时写成可调参数。应答检测同理原文的while((P2IN BIT1) BIT1);是死等从机不在线就永远出不来。我一般会改成带超时的版本顺便把返回值带出去方便上层定位到底是地址没应答还是数据没应答/* 返回 0 收到 ACK, 1 超时无应答 */ unsigned char iic_wait_ack(void) { unsigned int timeout 2000; unsigned char ret 1; SDA_RELEASE(); iic_delay(); SCL_RELEASE(); iic_delay(); while (timeout--) { if ((P2IN SDA_BIT) 0) { ret 0; break; } /* 从机拉低 ACK */ } SCL_LOW(); return ret; }超时计数值 2000 不是随便写的它要大于一个完整字节传输所需的循环次数又不能大到让故障响应慢到不可接受。按 100kHz 估算9 个时钟约 90 微秒2000 次空转在 1MHz 主频下大约几毫秒足够覆盖应答窗口又能在器件掉线时快速返回。4. WriteNbyte 与 ReadNbyte双字节地址和高低位顺序24C256 和 24C02 最大的接口差异在于地址宽度。24C02 只需发一个字节的地址24C256 要发两个字节先高后低。这一条听起来简单实际是最常见的移植失败原因代码从 24C02 抄过来函数签名都没改只发了一个地址字节器件把第二个字节当成数据直接写进去了结果是地址错位、数据错乱读回来一堆看似合理实则无意义的值。4.1 写时序0xA2、高地址字节、低地址字节、数据、tWR一次页写事务的完整序列是起始位、设备地址加写标志、等 ACK、地址高字节、等 ACK、地址低字节、等 ACK、若干数据字节、每字节等 ACK、停止位、等待内部写周期结束。设备地址的高 4 位固定为1010低 3 位由 A2/A1/A0 引脚电平决定最低位是读写标志。原文用的0xA2对应1010 001 0即三根地址脚接成了 001读地址就是0xA3。这个值不是常量板上改一次跳线帽就得跟着改。#define DEV_ADDR_W 0xA2u /* 1010 A2A1A0 0, 此处 A2A1A0 001 */ #define DEV_ADDR_R 0xA3u /* 返回 0 成功, 1 总线无应答, 2 参数错, 3 跨页 */ unsigned char ee_write(unsigned int addr, const unsigned char *buf, unsigned char len) { unsigned char i; if (len 0 || len 64) return 2; /* 单次不能超一页 */ if (((addr 0x3F) len) 64) return 3; /* 跨页直接拒绝, 由上层切分 */ iic_start(); if (iic_wait_ack_after(DEV_ADDR_W)) { iic_stop(); return 1; } if (iic_wait_ack_after((unsigned char)(addr 8))) { iic_stop(); return 1; } if (iic_wait_ack_after((unsigned char)(addr 0xFF))) { iic_stop(); return 1; } for (i 0; i len; i) { if (iic_wait_ack_after(buf[i])) { iic_stop(); return 1; } } iic_stop(); return 0; }addr 8取高字节、addr 0xFF取低字节这个顺序写反了器件不会报错只会把地址解释成一个完全不同的位置属于最难查的一类错误。函数里那句跨页判断((addr 0x3F) len) 64是整个封装的护城河它用一个位与运算换算出当前页内偏移加上待写长度一旦越过 64 就直接返回错误码把问题挡在总线动作之前。相比让数据悄悄回卷早失败要好得多。停止位之后不能立刻发起下一次写器件内部要跑完擦写周期这段时间总线上的任何寻址都不会被应答。原文在WriteNbyte末尾放了delay(10)按 10 毫秒算对 5 毫秒的最大写周期是够的。用固定延时简单可靠代价是每写一页白等一半时间更常见的做法是应答轮询反复发起起始位加设备写地址直到器件回 ACK 为止void ee_wait_ready(void) { unsigned int guard 0; do { iic_start(); if (iic_wait_ack_after(DEV_ADDR_W) 0) { iic_stop(); return; } iic_stop(); /* 器件仍在忙, 不发 ACK, 重试 */ } while (guard 1000); }guard是防止器件真的掉线时死循环1000 次上限在绝大多数主频下都能覆盖 5 毫秒写周期。轮询的本质是利用了 EEPROM 的一个特性内部写周期进行时器件不响应任何地址包括自己的设备地址。4.2 读时序伪写定地址、重复起始、0xA3、最后必须 NACK读操作比写多一步。24C256 的读地址指针不能由外部直接设定必须先做一次「伪写」发起起始位、发写地址、等 ACK、发两个字节的目标地址、等 ACK但不发任何数据然后用重复起始位重新接管总线再发读地址。这一步如果漏了读出来的永远是从上一次操作遗留指针开始的内容。unsigned char ee_read(unsigned int addr, unsigned char *buf, unsigned char len) { unsigned char i; if (len 0) return 2; iic_start(); if (iic_wait_ack_after(DEV_ADDR_W)) { iic_stop(); return 1; } /* 伪写, 只定地址 */ if (iic_wait_ack_after((unsigned char)(addr 8))) { iic_stop(); return 1; } if (iic_wait_ack_after((unsigned char)(addr 0xFF))) { iic_stop(); return 1; } iic_start(); /* 重复起始, 不产生 STOP */ if (iic_wait_ack_after(DEV_ADDR_R)) { iic_stop(); return 1; } for (i 0; i len; i) { buf[i] iic_read_byte(); if (i len - 1) iic_send_ack(); /* 还要继续读, 回 ACK */ } iic_send_nack(); /* 最后一字节必须 NACK */ iic_stop(); return 0; }最后那个 NACK 是协议强制要求不是可选优化。主机回 ACK 的意思是「我还要下一字节」回 NACK 才表示「到此为止」从机收到 NACK 才会释放 SDA主机才能顺利发出停止位。漏掉 NACK 的典型现象是单字节读正常多字节读最后一字节变成 0xFF或者停止位发不出去、总线被占住。这里的len可以大于 64因为读路径不存在页回卷从机会沿 15 位地址一路递增读到 0x7FFF 再绕回 0x0000。所以整片 dump 完全可以一次读完不必按页切分。这点和写路径的不对称值得在接口设计时明确写进注释否则接手的人很容易把写的限制照搬到读上把一次事务拆成几十次。5. 常见问题排查五个把数据写丢的坑5.1 现象所有地址读回都是 0xFF示波器上看不到任何应答原因通常是设备地址算错。常见的情形有两种一是板上 A2/A1/A0 接了跳线代码里还留着0xA2二是从 24C02 移植过来把 24C02 的0xA0直接抄过来用。24C256 的高 4 位固定1010低 3 位地址脚加读写位才凑成完整字节地址脚接法不同就必须改常量。解决办法是先用扫描的方式把所有可能的设备地址试一遍把0xA0到0xAE的偶数地址逐个发写地址等 ACK哪个有应答就用哪个。另外别忘了查上拉电阻SDA/SCL 没有 4.7k 左右的上拉或者上拉接到了 5V 而 MCU 是 3.3V 供电波形会抬不起来同样表现为全程无应答。5.2 现象单帧写读正常连续写几十帧后前面数据被覆盖这是典型的跨页回卷。原因在于写入长度没有对齐到 2 的幂或者虽然长度对齐了但起始地址没对齐。比如一帧 30 字节存进 32 字节槽槽的起点却是index * 30第 3 槽从 60 开始写 32 字节就会越过 63 回卷到 0。解决办法是把地址计算和长度计算统一到同一个块大小常量上起始地址只能是块大小的整数倍。写完一段立刻回读校验尤其是紧挨页边界的那几帧回读能第一时间暴露回卷。5.3 现象偶发丢帧重试就好负载一高必现多半是写周期没等够。固定delay(10)在多数情况下够用但如果主频漂移、编译器把延时循环优化掉、或者系统里有中断打断10 毫秒可能实际只有几毫秒下一次写的设备地址正好落在器件忙的窗口里直接无应答数据就丢了。重试能成功是因为第二次恰好错过了忙窗口。解决办法是改用 ACK 轮询不要赌延时。如果坚持用固定延时至少把它写成一个不被优化掉的volatile循环并且在最坏温度条件下实测一次。5.4 现象程序卡在某一行出不来看门狗复位后又能跑一阵死等应答是元凶。while ((P2IN BIT1) BIT1);这种写法在器件掉线、总线被某个从机拉死、或者上电时序不对时永远不会退出。改进办法是全部应答检测加超时计数超时后主动发停止位释放总线并返回错误码。如果总线真的被拉死还需要补一段恢复动作给 SCL 手动打 9 个时钟让卡在半截的从机把字节发完再补一个停止位。5.5 现象读回的数据整体右移一位或者首字节变成 0xFF先查 SDA 方向切换。读字节之前如果没有把 SDA 切回输入主机仍在推挽输出低电平从机发的 1 根本抬不起来读到的高位全是 0。另一个可能是发送字节时先改 SCL 再改 SDA违反「SCL 低电平期间改数据」的规则从机在上升沿采样到的就是上一个位的值于是整串数据错位一位。解决办法很简单把「SCL 拉低 → 设置 SDA → 拉高 SCL → 采样」这个四拍写成一个不可拆的函数所有位操作都走它别在业务代码里手写引脚动作。6. 进阶用法把任意长度记录塞进 32 字节槽位并做掉电校验页对齐解决的是不覆盖掉电校验解决的是不信任。EEPROM 擦写过程中掉电落在半个字节上的概率不低读回来是一个合法但错误的值。我一般会在每个 32 字节槽里切出 4 字节做头部2 字节序号、1 字节长度、1 字节 CRC8剩下 28 字节放数据写入前算好 CRC读出后重新校验不通过就当这一槽无效。#define SLOT_SIZE 32 #define SLOT_NUM (32768u / SLOT_SIZE) /* 1024 槽 */ /* 头部 4 字节数据 28 字节, 显式序列化, 不用结构体直接落盘 */ static unsigned char crc8(const unsigned char *p, unsigned char n) { unsigned char c 0x00, i, b; for (i 0; i n; i) { c ^ p[i]; for (b 0; b 8; b) c (c 0x80) ? (unsigned char)((c 1) ^ 0x07) : (unsigned char)(c 1); } return c; } unsigned char log_append(unsigned short seq, const unsigned char *frame) { unsigned char slot[SLOT_SIZE]; unsigned int addr (unsigned int)(seq % SLOT_NUM) * SLOT_SIZE; unsigned char i; slot[0] (unsigned char)(seq 8); /* 序号高字节 */ slot[1] (unsigned char)(seq 0xFF); /* 序号低字节 */ slot[2] 28; /* 有效长度 */ for (i 0; i 28; i) slot[4 i] frame[i]; slot[3] crc8(slot[4], 28); /* 只校验数据区 */ if (ee_write(addr, slot, SLOT_SIZE)) return 1; ee_wait_ready(); return 0; }这里刻意不用typedef struct直接强转指针落盘。结构体有对齐填充不同编译器、不同优化等级下 sizeof 可能不是 32字段偏移也会变换个工具链读旧数据就是一片乱码。手动按字节序列化虽然笨但字节序和偏移都写在明面上跨平台移植时不用返工。校验策略额外开销能发现的错误适用场景无校验0 字节无可重采的临时缓存序号长度3 字节槽位错位、长度异常定长记录CRC84 字节单字节翻转、短突发错误参数区、日志CRC16 双备份8 字节长突发错误、整槽损坏标定参数、掉电敏感数据seq % SLOT_NUM让写入位置自动环形推进序号本身单调递增读取时按序号排序就能还原时间顺序比维护一个读写指针更抗掉电。代价是老数据会被覆盖如果某些记录必须长期保留就得把环形区和高可靠区分开高可靠区用双备份加 CRC16。从那以后我每次碰 EEPROM都强制先跑一遍「地址对齐检查跨页拒绝回读 CRC」这三步哪怕只是存几个标定参数。这三步加起来不到五十行代码却能省掉大量「数据偶尔不对但复现不了」的排查时间。希望帮到你。本文还有配套的精品资源点击获取

24C256 EEPROM页写边界、地址回卷与I2C时序实践

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