LPDDR4信号完整性测试指南：CK时钟与DQS选通信号实测方法-北京尧图网络

简介这是一份面向硬件工程师、信号完整性测试人员与嵌入式开发者的LPDDR4信号完整性测试指导文档。内容聚焦CK时钟与DQS数据选通信号系统讲解差分/单端输入电压、输入斜率、交叉点等判定标准并依据JESD209-4B规范给出示波器采样、平均值计算及寄存器配置要点。读时序涵盖tDQSCK、tDQSQ、tQH、tQSL/tQSH、tRPRE、tRPST等关键参数写时序涵盖tDQS2DQ、tDQSS、tWPRE等均配有测量方法和实测波形举例。文档为docx格式共1个文件压缩包大小4.1MB已有2002人学习参考。对需要快速建立LPDDR4测试流程、核对信号质量判定标准或排查高速接口稳定性问题的工程师来说是一份可直接落地的参考手册。1. LPDDR4 信号完整性测试从 CK 到 DQS 的实测路径LPDDR4 系统里最让人半夜加班的往往不是逻辑功能问题而是 CK 时钟和 DQS 选通信号在高速翻转时那些“看起来还行”的波形。LPDDR4 信号完整性测试就是把 CK 的差分/单端电压、斜率、交叉点和 DQS 的对应参数以及一长串读时序指标逐个量化成能直接判定的测量项。这份指导覆盖的正是这三块CK 时钟信号测试、DQS 数据选通信号测试、时序参数测试。它适合做硬件测试、SI 仿真验证、以及内存 bring-up 的工程师直接照着搭测试环境。核心思路就三句话先读寄存器定准参考电平再用示波器把差分和单端分开测最后按 preamble 类型区分后再测时序。2. CK 时钟信号测试差分斜率、单端电压与交叉点的判定方法CK 是整颗 LPDDR4 的时基时基偏了后面的读写时序全部白测。我一般会把 CK 测试拆成三个层面来看差分电压和差分斜率解决“信号有没有力气”的问题单端电压解决“判决电平放没放对”的问题交叉点解决“共模电平和占空比受没受干扰”的问题。这样拆开以后定位波形异常会快很多不用靠肉眼猜。2.1 CK 差分输入电压与判定标准差分输入电压定义很简单Vdiff CK_t - CK_c。测量时用差分探头接到颗粒侧的 CK 焊盘或测试过孔探头方向必须和 CK_t/CK_c 一一对应接反了 VIH 和 VIL 会直接互换判定结果完全反过来。操作上我会按这三步走示波器带宽限制设为探头标称带宽直流耦合打开长余辉模式。触发源选 CK_t 的上升沿触发电平设在 VREFCA 附近。一次采集多个时钟周期用示波器的测量函数分别读 CK_t 与 CK_c 的稳态高、低电平再用计算通道算出差分值。测量项测量内容判定依据VIH(diff)CK_t 与 CK_c 差分高电平稳态值芯片手册 VIH(diff) minVIL(diff)CK_t 与 CK_c 差分低电平稳态值芯片手册 VIL(diff) maxVsw(diff)差分摆幅峰峰值芯片手册差分摆幅区间判定标准以所用 LPDDR4 颗粒的规格书为准不同速率等级数值不同。很多手册的 VIH(diff) 和 VIL(diff) 是相对 VREFCA 定义的而 VREFCA 是训练后的动态值这一点在 2.3 节会专门讲。测差分电压时不要看单次毛刺要看长余辉下的稳态包络毛刺只是干扰耦合不代表驱动能力。2.2 CK 差分输入斜率定义、判决门限与标准差分输入斜率描述的是信号在穿越判决门限区间时的变化速度本质是 dV/dt。LPDDR4 的判决门限不是“高电平一个点、低电平一个点”而是一个区间信号必须能从 VIL(diff) 判决点快速爬升到 VIH(diff) 判决点反之亦然。斜率太慢说明驱动偏弱、走线损耗过大或者容性负载太重系统在高温或低电压下很容易丢时序裕量。测量斜率的常见做法是直接在示波器上加微分通道或者在测量菜单里选 dV/dt 斜率测量。我更习惯用微分通道因为能同时看到斜率变化的全过程发现某个沿中间出现“塌陷”还能顺势判断是走线阻抗不连续还是接收端负载异常。项目门限定义判定方式上升沿斜率VIL(diff) 到 VIH(diff) 区间的 dV/dt手册规定的最小斜率下降沿斜率VIH(diff) 到 VIL(diff) 区间的 dV/dt手册规定的最小斜率判决门限位置以 VREFCA 为中心的电平区间手册定义的 VIH/VIL 绝对值这里有个高频坑差分探头的带宽不够会把真实斜率“磨平”测出来的 dV/dt 低于实际值。我一般要求差分探头的带宽不低于 4 GHz并且在测试前用已知快沿信号做一次自检。另一个坑是测试点选得太远比如过了多个过孔、走了很长一段 PCB 线再测这时候看到的是被通道劣化后的斜率不是颗粒引脚处的真实信号。2.3 CK 单端输入电压VREFCA 与 MR12 寄存器单端输入电压是相对 VREFCA 定义的而 LPDDR4 的 VREFCA 不是固定值。颗粒上电后会做 VREFCA Training内部自动调整参考电平调整完的值放在 MR12 寄存器里。如果测试时还拿默认 VREF 或者手册典型值当参考单端电压的判定结果会整体偏移甚至把合格信号判成不合格。我在实际测试前一定会先做这一步系统上电等待 LPDDR4 完成 VREFCA Training。通过主控固件或协议分析仪读取 MR12拿到训练后的 VREFCA。把示波器的参考电平设置为该 VREFCA 值。用单端探头分别测 CK_t 和 CK_c 对地电平记录 VIH(se) 和 VIL(se)。将结果与“VREFCA ± 手册定义的 ΔV”比较。单端参数表达式判定参考CK_t/CK_c 高电平VREFCA ΔVIH手册给定 ΔVIHCK_t/CK_c 低电平VREFCA - ΔVIL手册给定 ΔVIL这个环节最容易翻车的不是示波器而是寄存器读取渠道不通。有些调试板的主控固件没有把 MR12 暴露到日志里我一般会让固件工程师在 MRS 命令回包里打一条打印或者用协议分析仪直接抓 MRS 写命令把 MR12 的值解析出来。寄存器没读到之前单端电压测试结果先不要写进报告。2.4 CK 单端信号交叉点与判定标准交叉点就是 CK_t 上升沿和 CK_c 下降沿交汇处的电平。正常时应落在 VREFCA 附近一个很小的窗口内。交叉点整体上抬或下降说明共模电平发生了漂移或者时钟信号的占空比已经不对称了。这个指标对后续 PLL 和 DLL 的稳定性影响很直接。测量方法是在直流耦合、长余辉模式下用光标分别锁定 CK_t 的 50% 上升沿电平和 CK_c 的 50% 下降沿电平两者交汇处的电压就是交叉点。判定标准通常由颗粒手册给出绝对窗口比如 VREFCA 上下各几十毫伏的区间。交叉点偏移如果超过窗口我一般会回头查这几项CK 走线是否跨分割、CK_t/CK_c 是否等长、差分对内是否加了不对称的串阻或滤波电容。3. DQS 信号测试从差分电平到单端交叉点的完整检测流程DQS 的测试项目和 CK 大体同构但有一个本质区别DQS 只在读写突发期间出现不是连续信号。抓取稳定波形的窗口很窄触发策略必须跟着读写命令走。另外LPDDR4 的每个 Channel 要分 LDQS低 8 位和 UDQS高 8 位两组分别测。低 8 位和高 8 位的走线长度、过孔数量不可能完全一致拿一组结果代替另一组属于经验主义该翻车的时候一定会翻车。3.1 DQS 差分输入电压与判定标准DQS 差分输入电压的定义和 CK 一致Vdiff DQS_t - DQS_c。差别在于 DQS 是双向信号读突发和写突发时波形方向不同测试时分清当前测的是读方向还是写方向。我的测量步骤是示波器同时接 CK_t/CK_c 差分探头和 DQS_t/DQS_c 差分探头。触发源用 CK 交叉点触发条件配合读命令或写命令。在突发窗口内用长余辉累积波形测量 DQS 差分 VIH/VIL。测量项测量内容判定依据DQS VIH(diff)DQS_t 与 DQS_c 差分高电平手册 DQS VIH(diff) minDQS VIL(diff)DQS_t 与 DQS_c 差分低电平手册 DQS VIL(diff) maxDQS Vsw(diff)DQS 差分摆幅手册差分摆幅区间判定标准和 CK 一样以规格书为准。但有一点要注意读方向的 DQS 由颗粒驱动摆幅通常比写方向小测试时不能拿一个方向的判定结果覆盖另一个方向。我一般都会在读方向和写方向各抓一组数据分开记录。3.2 DQS 差分输入斜率门限与实测步骤DQS 的差分斜率直接影响 DQ 的采样窗口。斜率不足DQS 交叉点附近的抖动会变大DQ 建立保持时间被压缩最终表现为整机在高温回归时随机数据错误。实测步骤里门限设置是关键在示波器微分通道上设 DQS 差分斜率测量。门限区间按手册给出的 VIL(diff) 到 VIH(diff) 设置。分别读读突发和写突发的上升沿、下降沿斜率。DQS 斜率判据和 CK 不一定相同具体数值以颗粒手册为准。常见做法是手册给一个最小斜率要求实测值至少要留出 20% 以上的余量。如果斜率余量不足先看差分探头位置是否过于靠近主控端排除探头因素后再看 DQS 走线是否过长或串阻是否偏大。3.3 DQS 单端输入电压VREFDQ 与 MR14 寄存器DQS 单端电压同样要参考电压基准LPDDR4 的 DQS 基准是 VREFDQ同样经过 Training 后自动调整训练后的值存放在 MR14 寄存器里。测试前必须读取 MR14否则单端判定会整体偏移。我一般按这个流程走上电并完成 VREFDQ Training。读取 MR14记录 VREFDQ 实际值。示波器参考电平设为该值。分别测 DQS_t 和 DQS_c 对地的高、低电平。单端参数表达式判定参考DQS_t/DQS_c 高电平VREFDQ ΔVIH手册给定 ΔVIHDQS_t/DQS_c 低电平VREFDQ - ΔVIL手册给定 ΔVIL这里比 CK 多一个细节DQS 是双向信号读方向和写方向的单端电压可能是不同的电平域因为读写驱动器的输出强度设置不一定相同。我建议在报告里把方向和对应的 VREFDQ 一并标注避免后续评审时对着数据来回猜。3.4 DQS 单端交叉点测试与 LDQS/UDQS 分组DQS 单端交叉点的测量方法和 CK 相同核心也是看交叉电平是否落在 VREFDQ 附近的窗口内。交叉点偏移会直接改变差分信号的占空比进而影响 DQ 采样位置。分组测试是 LPDDR4 的硬性要求。以单 Channel 为例要分别测 LDQS 和 UDQS分组覆盖数据位必须单独测量项LDQSDQ[7:0]差分电压、斜率、单端电压、交叉点UDQSDQ[15:8]差分电压、斜率、单端电压、交叉点实际项目中Channel 数量以主控支持的路数为准每一路的 LDQS/UDQS 都要留独立的测试记录表格。不要因为两组波形看着差不多就只保存一组截图后期定位高低温偶发错误时这组数据能省下大量排查时间。4. 时序测试方法tCK/tCH/tCL 与读时序参数的示波器操作时序测试是信号完整性测试的收口环节。前面测的电压和斜率反映的是信号质量时序参数则直接反映“数据能不能被正确采样”。这一章我先讲时钟三项指标 tCK(avg)、tCH(avg)、tCL(avg) 的实测方法再分别展开读时序和写时序中几个关键参数的测量操作。LPDDR4 时序测试最核心的原则是每一个参数都要在指定的触发条件和 preamble 类型下测量触发选错数据就是废的。4.1 时钟指标 tCK(avg)/tCH(avg)/tCL(avg) 的测量方法JESD209-4B 对这三个指标的定义都是从 200 个连续时钟周期里取平均。tCK(avg) 是平均时钟周期tCH(avg) 是平均高脉冲宽度tCL(avg) 是平均低脉冲宽度。实际测试时不一定要一次抓满 200 个周期示波器单次采集几十个周期用平均测量函数也能得到足够稳定的结果如果想严格对齐 JEDEC 定义就用长时基抓 200 个周期以上再统计。我常用的 SCPI 自动化测量脚本片段如下# 示波器SCPI脚本片段连续采集多个时钟周期后取平均tCK scope.write(:TIMebase:SCALe 5e-9) # 时基 5 ns/div单屏约数十个周期 scope.write(:ACQuire:MODe AVErage) scope.write(:ACQuire:COUNt 64) # 64 次平均抑制随机噪声 scope.write(:MEASure:CLEar) scope.write(:MEASure:PERiod:SOURce CH1) # CH1 接 CK_t 单端探头 scope.write(:MEASure:PERiod:STATe ON) scope.run() period float(scope.query(:MEASure:PERiod:VALue? CH1)) print(ftCK(avg) {period * 1e12:.2f} ps)这段脚本的逻辑是先把时基设为 5 ns/div让单屏容纳足够多的完整周期再开 64 次平均把随机噪声滤掉最后用周期测量函数直接返回平均值。参数上要注意时基和采样率的关系时基太大会导致单周期采样点不足斜率信息丢失一般保证每个周期不少于 50 个采样点。平均次数也不是越多越好64 次足够多了会拖慢刷新率调试时看不到实时变化。tCH(avg) 和 tCL(avg) 的测量方式类似把测量函数换成高脉冲宽度和低脉冲宽度与 tCK(avg) 相除得到占空比再和手册区间比较。这三个指标反映的是 PLL 的锁定质量和时钟树的设计裕量我会在常温、低温、高温三个点都留一组数据。4.2 读时序 tDQSCK 与 tRPRE/tRPST 的测量tDQSCK 描述 DQS 上升沿与 CK_t/CK_c 之间的时间关系测量方式取决于 preamble 类型。LPDDR4 的 Read preamble 类型由寄存器 MR1 第 3 位设置默认是 Static 类型DQS 在前导期间保持静态电平如果配成 Toggling 类型DQS 在前导期间已经规律翻转。两种类型下DQS 第一个数据沿的参考起点不同测 tDQSCK 时如果不先确认 MR1[3]测出来的值可能偏差巨大。我的测量步骤是读取 MR1确认第 3 位的 preamble 类型。示波器同时接 CK_t/CK_c 和 DQS_t/DQS_c。触发源选 CK 交叉点捕捉一次读突发。从 CK 交叉点量到 DQS 第一个有效数据沿。Preamble 类型DQS 前导行为测量参考点Static保持静态高/低电平DQS 第一次跳变沿Toggling前导期间规律翻转最后一个预翻转沿后的首个数据沿tRPRE 即 Read preamble固定时长 2tCK测量从 DQS 进入前导状态到第一个数据沿之间的时间。tRPST 即 Read postamble时长由 MR1 寄存器第 7 位决定0B 对应 0.5tCK1B 对应 1.5*tCK测量从最后一个数据沿到 DQS 恢复静态电平之间的时间。这两个参数直接关系到读数据的有效窗口边界。实测中如果 tRPRE 偏短常见原因是前导起点判错如果 tRPST 偏短则要重点检查主控端是否在 postamble 期间提前释放了 DQS 总线控制权。4.3 tDQSQ 与 tQHDQ 与 DQS 联动参数测试tDQSQ 描述的是每组内 DQ 最后一次有效转换与 DQS 交叉点之间的最大偏斜tQH 描述的是 DQ 保持有效的最短时间窗口。一个偏斜一个保持两个参数合起来决定了读数据窗口的左右边界。测量方法如下抓取读突发波形同时采集 DQS_t/DQS_c 和同一组内的 8 根 DQ。对每一根 DQ 测量最后一个有效跳变沿相对 DQS 交叉点的时间差取最大值作为 tDQSQ。对每一根 DQ 测量最早无效跳变沿相对 DQS 交叉点的时间差取最小值作为 tQH。参数描述测量取点tDQSQDQ 最后一次有效转换到 DQS 交叉点组内所有 DQ 的最大偏斜值tQHDQ 输出保持时间组内最早变无效的 DQ这里建议把“组内所有 DQ 逐根测量取最差值”做成固定习惯。只测一两根 DQ 就下结论很容易漏掉走线最长、过孔最多那根数据线的问题。我在实际项目中会把每组 8 根 DQ 的数值全部列进报告用数字信号处理的思路去统计均值和极差极差偏大就说明组内 skew 有问题。4.4 写时序参数 tDQSS 与 tDQS2DQ 的测量写时序测试需要同时抓到命令总线、CK、DQS 和 DQ。tDQS2DQ 描述的是 DQS 上升沿与 DQ 数据中心的偏移这个参数和写调优直接相关主控在写 DQS 相位校准后的实际效果就反映在这里。测量步骤触发条件设为写命令CS_n 下拉同时 CK 上升沿。同时采集 CK_t/CK_c、DQS_t/DQS_c 和 DQ。测量 DQS 上升沿交叉点与 DQ 数据有效窗口中心的时间差。参数描述测量要点tDQS2DQDQ 到 DQS 的偏移量DQS 交叉点与 DQ 中心的时间差tDQSS写命令到首次 DQS 跳变CS_n 与 CK 对齐边界到 DQS 首个沿tDSS/tDSHDQS 下降沿相对 CK 的 setup/hold以 CK 交叉点为参考边界写时序测试的坑主要在触发如果只触发 DQS 自跳变很难判断写命令的相对位置tDQSS 根本测不准。务必把触发条件锁定在命令总线边界上让 CK、命令、DQS 和 DQ 四条信号在同一时间基下对齐。5. LPDDR4 信号测试避坑指南寄存器、Preamble 与触发的常见误区时序测试做多了以后你会发现大部分“测试失败”其实是测量方法错了不是信号真的不合格。下面这几条是我自己在 LPDDR4 项目里反复踩过的坑每一条都是先看到异常现象追查半天才发现根源在测量设置。5.1 MR12/MR14 没读就判单端电压参考电平整体偏移现象CK 或 DQS 的单端电压测量结果和规格书比较出现“全体超限”或者“全体偏低”的系统性偏移而且偏移方向一致。原因LPDDR4 的 VREFCA 和 VREFDQ 都是上电后经过 Training 自动调整的默认 VREF 和训练后的实际值可能相差几十毫伏。没读 MR12/MR14 就按默认值判定等于整套判决电平都放错了位置。解决把所有单端测量项都放到 Training 完成之后执行。测试前先读 MR12 和 MR14把寄存器值写入测试记录表再把示波器参考电平设置为训练后值。从那以后我每份单端测试报告的第一行一定是 VREFCA/VREFDQ 的实际寄存器值。5.2 Preamble 类型没对齐tDQSCK 测出的时间明显偏短现象tDQSCK 测量结果比规格书典型值短了一大截波形里 DQS 在数据沿之前多出一串规律翻转。原因MR1 第 3 位把 Read preamble 配置成了 Toggling 类型测试时却按 Static 类型的参考点去卡第一个数据沿把 preamble 里的预翻转沿误当成了数据沿。解决测读时序前先查 MR1确认 preamble 类型。Static 从第一次跳变沿起算Toggling 要跳过预翻转沿、从最后一个预翻转沿之后的有效数据沿起算。区分清楚后再配置示波器测量起点。5.3 触发源选错读后导 tRPST 抖动大到没法读数现象tRPST 多次测量结果离散度极大同样的波形重复测几次读数差出几百皮秒。原因触发源选在了 DQS 自身上。DQS 在突发结束后的保持阶段电平不确定触发点会来回抖导致测量窗口不稳定。解决触发源一律改成 CK_t/CK_c 交叉点或者用读命令总线的边界作触发。DQS 本身的交叉点只做观测不做触发。5.4 差分探头没做 de-skew斜率与交叉点双双失真现象CK 差分斜率怎么测都不达标交叉点位置持续偏移但把探头互换后结果又变了一个方向。原因差分探头的两个通道之间存在固有延迟差没有做 de-skew 校准就直接测量相当于给信号人为加了一个偏斜。解决测试前先对差分探头做通道间 de-skew 自校准再用已知快沿信号验证斜率测量值。这个过程两分钟就能做完但节省的排查时间是以小时计的。5.5 只测了低 8 位高 8 位时序超差被漏掉现象LDQS 组测试全绿整机做高低温回归时偶发数据错误定位到 UDQS 对应的 DQ 组。原因测试计划里只覆盖了 LDQS认为两组走线长度接近、波形也接近没必要重复测。但高法层的过孔换层、参考平面开槽都会让 UDQS 组实际时序偏差更大。解决每个 Channel 的 LDQS 和 UDQS 都分组、分方向完整测量tDQSCK 和 tDQSQ 逐项记录。走线再接近也经不起一根过孔的反焊盘掏空带来的差异。6. 极限 Margin 扫描用相位偏移和眼图锁定 LPDDR4 信号余量6.1 固定 VREF扫 DQS 相位偏移等基础项全部合格之后我习惯再往前走一步把 DQS 相位偏移从中心位置逐步往左右扫看 DQ 采样还能不能保持正确。具体做法是让主控在寄存器里调整 DQS 的 phase offset每步 1/64 tCK 左右同时记录 DQ 误码率或眼图高度。扫出来的“相位余量窗口”如果接近规格书极限说明布线余量不足当前跑在边界上如果窗口很宽说明设计留有足够余量可以直接进入量产评估。这个方法和 tDQS2DQ 的数据配合使用效果最好。tDQS2DQ 告诉你当前 DQS 相对 DQ 中心的位置相位扫描告诉你这个位置离左右边界各有多远两个数据合起来就是完整的写时序裕量画像。6.2 把关键时序做成温度电压矩阵单点测量永远不够LPDDR4 的时序参数会随温度和供电电压漂移。我会把常温初调通过后再把温度、VDDQ 电压做成矩阵每个工况下记录 tDQSCK 和 tQH 的直方图看均值和 3σ 边界。工况tDQSCK 均值tDQSCK 3σtQH 均值tQH 3σ结论常温 25°C记录记录记录记录合格/临界低温 -20°C记录记录记录记录合格/临界高温 85°C记录记录记录记录合格/临界这里的统计思路其实就是拿数字信号处理里最基础的均值方差去做判决避免用一次抓拍的数据下结论。如果某个温度点的均值没有漂移、但 3σ 明显变大说明抖动来源在此时被放大了需要回头查 CK 的差分斜率和电源纹波。从那以后我每次接手新的 LPDDR4 项目都会先花十分钟把 MR12/MR14 的值和 preamble 类型打印出来再进 SI 测试。这两步做完后面一半的“假失败”都不会发生。完整的测试记录模板和判定对照表我放在配套的《LPDDR4 信号完整性测试指导》资料里了照着填就能出报告。希望这套流程能帮到你。本文还有配套的精品资源点击获取

LPDDR4信号完整性测试指南：CK时钟与DQS选通信号实测方法

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