FMC与FMC+接口标准详解：从引脚定义到高速信号设计的工程实践-北京尧图网络

1. FMC与FMC到底是什么从一块板卡的“接插件焦虑”说起搞FPGA硬件设计的人迟早会撞上一个问题板子上的高速接口不够用了。摄像头、ADC、DAC、光纤模块、射频前端一个个都嗷嗷待哺地等着往FPGA上挂可FPGA芯片本身的引脚就那么多PCB面积也有限你不可能给每个外设都单独拉一组走线。这时候FMCFPGA Mezzanine Card就登场了。FMC本质上是一个标准化的夹层卡接口规范由VITA组织制定标准号是ANSI/VITA 57.1。你可以把它理解成FPGA世界里的“USB接口”——当然它比USB复杂得多。它的核心思路是在载板Carrier Board上放一个统一的连接器插座FPGA的引脚按照标准定义连到这个插座上然后各种功能子板Mezzanine Card只要做成符合这个标准的“插头”就能即插即用。今天插一块ADC采集卡明天换一块光纤通信卡载板和FPGA都不用动。这个思路解决的核心痛点非常实际。在没有FMC之前每个项目的外设接口都是定制化的硬件工程师画原理图、Layout、打样、调试一套流程走下来少说两三个月。如果项目需要换一个不同型号的ADC可能整个PCB都要重新设计。FMC把这个过程标准化之后子板可以独立设计、独立验证载板只需要保证FMC连接器的引脚分配符合规范就行。FMCVITA 57.4是FMC的升级版本主要解决的是带宽瓶颈问题。原始FMC标准定义了400个引脚实际上连接器有400个触点位置但并非全部都用满其中高速差分对的数量有限。随着ADC采样率越来越高、光纤速率越来越快原来的差分对数量不够用了。FMC把高速差分对从原来的最多约40对取决于连接器型号扩展到了最多80对单通道速率也支持到了28Gbps以上直接面向100G以太网、高速数据采集、相控阵雷达等应用场景。注意FMC和FMC在物理连接器上是兼容的。FMC的子板可以插到FMC的载板上但只能使用FMC定义的那部分引脚FMC的子板也可以插到FMC的载板上。这个向下兼容的设计非常关键避免了标准升级带来的硬件报废。适合阅读这篇文章的人正在做FPGA硬件选型的工程师、需要设计载板或子板的PCB工程师、做高速数据采集或通信系统架构的开发者以及刚入门FPGA、想搞清楚“板子上那个大连接器到底是干嘛的”的初学者。我会从标准定义、引脚分配、电气特性、实操设计要点几个维度展开尽量把VITA文档里那些枯燥的表格翻译成人话。2. 标准拆解VITA 57.1与VITA 57.4的核心差异2.1 连接器物理结构从400针到560针的演进FMC标准定义了几种连接器配置最常见的是单宽度Single Width和双宽度Double Width两种。单宽度子板尺寸是69mm x 76.5mm双宽度是139mm x 76.5mm。连接器本身是一个高密度阵列ASP-134486-01或类似型号是Samtec等厂商生产的标准FMC连接器。原始FMC连接器有400个触点位置分为A、B、C、D、E、F、G、H、J、K共10列每列40个引脚。但实际可用的高速差分对数量取决于你用的是哪种连接器变体。标准FMC连接器VITA 57.1提供LA[00:33]34对高速差分信号Low Pin Count Area低引脚数区域HA[00:23]24对高速差分信号High Pin Count Area高引脚数区域HB[00:23]24对高速差分信号仅双宽度连接器单宽度连接器只有LA和HA区域双宽度连接器额外有HB区域。所以单宽度最多58对差分双宽度最多82对差分。但实际可用数量还受限于连接器型号和引脚复用。FMCVITA 57.4把连接器扩展到了560个触点增加了额外的列。高速差分对数量大幅提升LA[00:33]34对保持不变HA[00:23]24对保持不变HB[00:23]24对保持不变HP[00:23]新增24对High Pin Count Plus Area这样FMC单宽度就能提供82对差分双宽度更是达到106对。而且FMC支持更高的单对速率GTY/GTM收发器可以直接通过连接器而不需要额外的重定时芯片。2.2 引脚功能分区为什么要有LA、HA、HB、HP的区分这个分区设计不是随便拍脑袋定的。LA区域Low Pin Count Area是所有FMC子板必须支持的最小集合它包含了基本的电源、JTAG、I2C管理接口和34对差分信号。这意味着即使你设计一个最简单的子板只要用LA区域的信号就能保证在几乎所有FMC载板上工作。HA和HB区域是可选扩展。载板设计者可以选择只连接LA区域成本低、布线简单也可以连接HA/HB来获得更多高速通道。子板设计者需要根据自己需要的带宽来决定用哪些区域。FMC新增的HP区域则是面向超高速应用的。HP区域的差分对在PCB布线时有更严格的阻抗控制和长度匹配要求通常需要载板使用更低损耗的板材如Megtron 6或类似等级。区域FMC差分对数量FMC差分对数量典型用途LA3434基本通信、低速ADC/DAC、控制信号HA2424中速数据采集、视频接口HB24仅双宽度24仅双宽度高速ADC、光纤HP无24超高速收发器、100G以太网2.3 管理接口I2C、JTAG和电源控制FMC标准定义了一套管理接口这是它区别于普通排针连接器的关键。每块FMC子板上都有一颗EEPROM通常是24LC02或兼容型号里面存储了子板的身份信息制造商、型号、序列号、电源需求、引脚分配描述等。载板上的控制器通常是FPGA或BMC通过I2C总线读取这些信息就能自动识别插上来的是什么子板。这个机制的实际价值在于热插拔和自适应。比如你做了一个通用载板今天插ADC子板明天插光纤子板FPGA通过读取EEPROM就能知道当前插的是什么然后加载对应的配置文件。不需要人工干预也不需要拨码开关。JTAG接口也是标准化的。FMC连接器上有一组JTAG信号TCK、TDI、TDO、TMS载板可以通过这些信号对子板上的器件进行编程或调试。不过实际使用中很多子板并不通过FMC连接器走JTAG而是自己留了调试排针。电源方面FMC标准定义了12V、3.3V、VADJ三组主要电源。12V和3.3V是固定电压VADJ是可调电压默认1.8V但可以通过载板上的电阻分压网络调整到1.2V、1.5V、2.5V等。VADJ的存在是为了适配不同I/O电平标准的子板。比如子板上的ADC是1.8V LVDS接口那VADJ就设成1.8V如果是2.5V LVCMOS就设成2.5V。实操心得VADJ的电压设置一定要和子板EEPROM里声明的电压一致。我见过有人载板VADJ设成1.8V子板却要求2.5V上电后子板上的电平转换芯片直接冒烟。上电前务必核对子板手册中的VADJ要求。3. 电气特性与信号完整性高速差分对的那些坑3.1 差分阻抗与布线要求FMC标准规定高速差分对的差分阻抗为100欧姆±10%单端阻抗50欧姆。这个要求看起来简单实际执行起来坑很多。首先FMC连接器本身的阻抗并不是完美的100欧姆在连接器过渡区域会有阻抗不连续。其次PCB走线的阻抗取决于叠层结构、线宽、线间距、铜厚、介质厚度等多个参数。我实际做过的项目中FMC差分对的布线有几个硬性要求长度匹配同一对差分信号的两根线长度差控制在5mil以内对于10Gbps以上信号建议3mil以内对间匹配如果是一组总线比如16对LVDS对与对之间的长度差控制在100mil以内具体取决于协议要求过孔数量尽量减少过孔每个过孔都会引入阻抗不连续和寄生电容参考平面差分对下方必须有完整的参考平面不能跨分割这些要求听起来是常识但实际Layout时很容易忽略。比如FMC连接器的引脚排列非常密集扇出时不可避免地要打过孔这时候过孔的设计就很关键。我通常会用背钻Back Drilling来减少过孔的寄生效应虽然成本会增加但对于28Gbps以上的信号是必要的。3.2 连接器选型不是所有FMC连接器都一样市面上能买到的FMC连接器有好几种价格从几十块到几百块不等。主要区别在于引脚数量单宽度还是双宽度高速性能支持的最高速率有些连接器只支持到10Gbps有些支持到28Gbps甚至56Gbps材料高温塑料还是普通塑料安装方式SMT还是通孔我一般推荐用Samtec的ASP系列或类似的高性能连接器。虽然贵但信号完整性有保障。便宜的连接器在低速应用比如100Mbps以下没问题但上了10Gbps就会出现明显的眼图闭合。还有一个容易被忽略的点连接器的配对高度。FMC标准定义了不同的堆叠高度从5mm到10mm不等载板和子板之间的间距必须匹配。如果选错了子板要么插不进去要么悬空导致接触不良。3.3 电源完整性与去耦FMC子板上的电源去耦经常被忽视。标准要求子板在12V和3.3V输入端有足够的去耦电容但具体放多少、放哪里很多人是凭感觉。我的经验是12V输入端至少放一个100uF的钽电容或电解电容再加几个10uF的陶瓷电容3.3V输入端至少放一个47uF的钽电容加多个1uF和0.1uF的陶瓷电容VADJ输入端根据负载电流决定一般至少放一个22uF的钽电容加若干0.1uF陶瓷电容去耦电容要尽量靠近连接器引脚放置走线要短而粗。我见过一个设计去耦电容放在子板另一头结果ADC采样时电源纹波大到影响信噪比。常见问题FMC子板上电后载板检测不到。排查顺序先量VADJ电压是否正常再查I2C总线上拉电阻是否焊接最后用示波器看EEPROM的SDA/SCL是否有波形。十有八九是I2C地址冲突或上拉电阻缺失。4. 载板与子板设计实操从原理图到调试4.1 载板设计要点FPGA引脚分配与约束设计FMC载板的第一步是确定FPGA的引脚分配。FMC连接器的引脚定义是固定的但FPGA端的引脚是你自己选的。这里有几个原则第一高速差分对必须连接到FPGA的收发器GT引脚或高性能I/O bank。比如Xilinx UltraScale系列HP bank支持的最高速率比HR bank高GTY/GTM收发器则专门用于超高速信号。如果你把FMC的HA区域差分对连到了普通HR bank那速率可能连5Gbps都跑不到。第二时钟信号要连到FPGA的专用时钟引脚MRCC/SRCC。FMC连接器上有CLK0和CLK1两组差分时钟通常用来给子板提供参考时钟或者从子板接收时钟。这些时钟信号必须连到FPGA的全局时钟引脚否则时钟抖动会很大。第三LA区域的单端信号可以连到普通I/O。LA区域除了差分对外还有一些单端信号如I2C、JTAG、复位等这些对引脚要求不高随便连到普通I/O即可。在Vivado或Quartus中做引脚约束时要特别注意I/O标准的设置。FMC的VADJ电压决定了I/O bank的VCCO电压。如果VADJ是1.8V那对应的I/O标准要设成LVCMOS18或LVDS1.8V。设错了轻则不工作重则烧芯片。4.2 子板设计要点EEPROM编程与引脚映射子板设计的核心是EEPROM内容的编写。FMC标准定义了一个特定的数据格式基于IPMI规范里面包含了子板的各种信息。你可以用FMC EEPROM编程工具很多厂商提供来生成二进制文件然后烧录到24LC02里。EEPROM里最关键的信息是引脚分配描述。它告诉载板我的LA区域第0对差分是输入还是输出电平标准是什么有没有端接电阻等。载板上的控制器读取这些信息后可以动态配置FPGA的I/O属性。不过实际项目中很多团队并不严格遵循这个规范。因为写EEPROM、调试I2C、验证兼容性都要花时间而项目进度往往很紧。我见过不少子板干脆不焊EEPROM载板也不读直接硬编码引脚配置。这样做省事但失去了FMC标准化的最大优势——互换性。我的建议是如果是内部项目、子板种类固定可以简化EEPROM但如果是产品化、需要支持多种子板那EEPROM一定要做而且要严格按照标准来。4.3 上电时序与保护电路FMC标准定义了上电时序12V先上然后3.3V最后VADJ。载板上的电源管理芯片要保证这个顺序。如果顺序错了子板上的器件可能因为I/O电压先于核心电压建立而损坏。保护电路方面至少要在12V和3.3V输入端加自恢复保险丝PTC和TVS二极管。我遇到过子板短路导致载板电源芯片烧毁的情况加了保护之后最多换根保险丝。还有一个细节热插拔。FMC标准支持热插拔但前提是载板和子板都有相应的保护电路。如果没有带电插拔可能产生浪涌电流损坏连接器触点或芯片。我一般建议客户不要带电插拔除非系统明确要求。实操记录曾经调试一块高速ADC子板采样率跑到1GSPS时数据误码率很高。排查了一周最后发现是FMC连接器的某个地引脚虚焊。重新补焊后误码率降到1e-12以下。教训FMC连接器的焊接质量一定要用X光检查尤其是BGA封装的连接器。5. 常见问题速查与避坑指南5.1 识别与枚举失败现象载板上电后FPGA读不到子板EEPROM或者读到的数据全是0xFF。排查步骤量VADJ电压确认在子板要求的范围内量I2C上拉电阻确认SDA和SCL在空闲时是高电平通常上拉到3.3V或VADJ用示波器看I2C波形确认有起始条件和地址帧检查EEPROM的写保护引脚WP是否接地确认I2C地址没有冲突FMC标准规定EEPROM地址是0xA0常见原因上拉电阻没焊、EEPROM型号不对有些型号的地址不一样、I2C总线被其他器件拉死。5.2 高速信号误码现象低速时数据正常速率一高就误码。排查思路先用示波器看眼图确认信号幅度和抖动检查差分对的长度匹配是否满足要求确认FPGA端的均衡器Equalizer设置是否正确检查参考时钟的抖动是否超标如果是背板连接检查连接器是否有信号完整性报告我的经验80%的高速误码问题出在PCB布线或连接器上20%出在FPGA的收发器配置上。先查硬件再调软件。5.3 电源相关问题问题现象可能原因解决方法子板不工作VADJ为0V载板VADJ使能信号未拉高检查载板电源管理芯片的使能引脚VADJ电压不对分压电阻选错根据子板要求重新计算分压电阻上电后子板发热严重电源短路或反接立即断电检查电源引脚是否短路纹波过大去耦电容不足增加陶瓷电容靠近负载放置5.4 机械与结构问题FMC子板的机械尺寸有严格规定尤其是面板开孔位置和连接器高度。我见过子板做出来插不进去机箱的情况就是因为面板开孔偏了几毫米。设计时一定要用VITA标准里的机械图纸做参考不要凭感觉画。另外固定螺丝也很重要。FMC连接器的插拔力不小如果没有螺丝固定振动环境下子板可能松脱。标准规定用M2.5的螺丝但实际用M3的也有。6. 从FMC到FMC的升级考量6.1 什么时候需要升级到FMC如果你的应用满足以下任一条件就应该考虑FMC需要超过58对差分信号单宽度或82对双宽度单通道速率超过10Gbps需要连接多个100G以太网端口使用最新的高速ADC采样率5GSPS或DACFMC的连接器虽然物理上兼容FMC但载板设计需要升级。主要是PCB材料要换成低损耗板材布线规则要更严格电源也要能提供更大的电流FMC允许更高的单引脚电流。6.2 兼容性设计技巧如果你要设计一个同时支持FMC和FMC的载板有几个技巧连接器选用FMC的型号560针但引脚定义兼容FMC电源设计留足余量至少支持FMC的最大电流PCB叠层按FMC的要求设计这样插FMC子板时性能更好在FPGA端把HP区域的差分对也连上即使暂时不用这样设计的载板成本会高一些但未来升级空间大。我一般建议客户如果项目周期超过两年直接上FMC载板。6.3 实际项目中的选型建议最后分享一个选型决策表是我在多个项目中总结出来的应用场景推荐标准连接器类型备注低速数据采集100MSPSFMC单宽度成本低LA区域够用中速视频处理FMC单宽度需要HA区域高速ADC1-5GSPSFMC双宽度需要HP区域和低损耗板材100G以太网FMC双宽度必须用FMCFMC带宽不够射频前端FMC双宽度需要多通道同步这个表只是参考具体还要看FPGA型号、项目预算和进度要求。我在实际项目中遇到过因为FMC连接器缺货而被迫改用FMC的情况所以选型时也要考虑供应链。个人体会FMC标准最大的价值不是技术本身而是它建立了一个生态系统。市面上有几百种FMC子板从ADC到光纤到电机驱动几乎覆盖了所有FPGA应用场景。你不需要什么都自己设计买一块现成的子板插上就能用。这个生态的价值远比省几根走线要大得多。

FMC与FMC+接口标准详解：从引脚定义到高速信号设计的工程实践

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