ARMv8/v9 SMMU系统架构解析：从DMA地址翻译到虚拟化实践-北京尧图网络

1. 整体设计与思路拆解1.1 SMMU到底是什么为什么ARMv8/v9绕不开它先说人话SMMUSystem Memory Management Unit就是给设备DMA用的MMU。CPU侧的MMU翻译CPU访问的虚拟地址SMMU翻译设备发起的DMA地址。没有它设备就拿着裸物理地址到处写虚拟化、内存隔离、IO安全全都无从谈起。ARMv8/v9体系里SMMU已经不是可选项而是高性能SoC的标配组件。这些年我在实际项目中遇到过各种各样的SMMU问题设备线程卡死、内存被DMA踩坏、虚拟机直通网卡性能暴跌、以及最折磨人的设备初始化顺序导致的fault风暴。可以说不懂SMMU做ARM SoC的BSP、虚拟化、安全固件、NFV数据面开发迟早会踩到深坑。这篇文章聚焦ARMv8/v9架构下的SMMU系统架构和功能概述我会从SMMU的定位、核心工作机制、STE/CD配置流程、驱动初始化、性能调优和故障排查几个角度展开尽量把原理和实操揉在一起讲这样对刚接触这块的同学更有抓手。1.2 为什么系统里必须有一个给DMA用的MMU很多刚接触嵌入式Linux的同学会有疑问CPU跑着MMUDMA直接访问物理地址不行吗非也。SMMU的存在有几个核心动机缺一个都不行。第一个动机是地址空间扩展与内存聚合。设备DMA可能需要连续的物理内存但系统运行久了物理内存碎片化严重很难找到大块连续内存。SMMU可以让DMA访问分散的物理页通过页表把不连续的内存映射成设备视角的连续IOVA相当于给设备做了一次“虚拟内存整理”。第二个动机是隔离与安全。多个设备、多个虚拟机共享物理内存如果设备能随便访问任意物理地址那Guest A的设备就可能在DMA时把Guest B的数据改掉甚至有没有权限都能读写。SMMU提供per-device的地址空间隔离把设备访问限制在一个划定的区域内防止越界DMA攻击。第三个动机是虚拟化。设备直通给虚拟机时Guest内部看到的是Guest物理地址IPA但真实硬件需要访问Host物理地址PA。SMMU的两级翻译就是为此设计的stage 1做VA到IPA的翻译由Guest的页表决定stage 2做IPA到PA的翻译由Hypervisor管控。这两级配合才能实现安全和性能兼顾的设备直通。第四个动机是共享虚拟地址SVA。设备和CPU共享同一个页表省去了数据拷贝这在高性能计算和数据中心场景越来越重要。1.3 回顾SMMU的演进从MMU-400到SMMUv3.2ARM官方早期的IOMMU是独立的MMU-400/401/500等产品型号后来才统一到SMMU这个架构规范下。SMMUv1/v2是比较传统的实现TSMTranslation Stage Management在SMMU内部维护微页表micro TLB支持的平台主要是ARMv7-A和早期ARMv8-A。它和ARMv8的虚拟化扩展对应stage 1 stage 2。SMMUv3则是面向ARMv8.2及以后的架构版本做了大量重设计。最明显的区别是命令队列Command Queue、事件队列Event Queue、优先级队列PRI Queue都改成了内存队列机制软件通过MMIO写doorbell来通知SMMU处理命令而不是像v2那样写寄存器。这极大降低了软件开销也为高性能设备提供更好的扩展性。SMMUv3.1和v3.2又增加了新特性比如支持52位物理地址、PE SVAProcess Shared Virtual Addressing、MPAM内存系统资源分区支持等。到ARMv9时代SMMUv3已经和CPU侧的FEAT_SVE、FEAT_LPA等特性协同内存管理能力大幅增强。1.4 SMMU在SoC总线拓扑里的位置搞清楚SMMU的位置对理解它为什么会产生某些现象特别重要。典型拓扑是这样的设备比如网卡、GPU、NVMe控制器通过AXI/ACE/CHI总线连接到SMMUSMMU再接下去是内存互连网络Interconnect最后接到DDR控制器。设备发出的每个DMA请求总线事务里都会携带一个标识StreamIDSMMU依据StreamID查找对应的STE决定怎么处理这次DMA是做bypass、做翻译还是直接abort。如果系统里有多个SMMU实例可以用分布式方式组成TBUTranslation Buffer Unit TCUTranslation Control Unit的层级TBU负责缓存和可能的翻译TCU负责页表walk。这种架构在大型SoC中常见因为总线接入点分散集中式SMMU的时延和拥塞都不可接受。这个拓扑直接影响了一件事DMA的访问延迟。SMMU命中TLB的话延迟大约多个十几个周期还能接受一旦TLB miss就要走页表walk代价就大了可能几百周期甚至更多。2. 核心机制拆解StreamID、STE与两级翻译2.1 设备怎么和SMMU“对上号”StreamID与SubstreamID每个DMA事务进入SMMU时总线协议中会有个标识来标记请求来自哪个设备。ARM术语里这个标识叫StreamIDSID。可以理解为每条DMA事务在门口报一下自己的“工号”SMMU根据工号去翻对应的配置单。StreamID在PCIe体系里就是Requester IDBus:Device.Function通常16bit在片上设备中则由SoC设计者定义一般用AXI的ID信号压缩而来。系统里可能有几百上千个设备SID范围可以很宽所以SMMU里有一个关键设计用Stream Table来存放所有设备的配置SID做索引。SubstreamID则是v3引入的概念对应PCIe的Process Address Space IDPASID。它的作用是在同一个设备里区分多个DMA地址空间。比如一个支持SVA的GPU或NVMe盘可以同时为多个进程服务每个进程有自己的页表SubstreamID用来定位到具体哪个进程的上下文。从软件角度看想给设备配置DMA翻译本质上就是给这个设备分配一个SID然后在Stream Table里设置对应的STE让STE指向一个或多个Context DescriptorCDCD再指向具体的页表。2.2 STE和CD的关系别把两者搞混SMMUv3里STEStream Table Entry是设备的入口配置大小为64字节其中包含配置字段STE.S1ContextPtr指向stage 1的CD表STE.S2TTB指向stage 2的页表基址还有各种使能位、缓存属性、bypass/abort策略等。CDContext Descriptor则描述了stage 1地址空间的信息类似CPU侧TTBR寄存器的角色。一个STE可以指向多个CD通过S1ContextPtr指向一个CD表SubstreamID作为索引每个CD包含TTB0/TTB1两级页表基址T0SZ/T1SZ地址空间大小划分页表格式颗粒度4K/64K/16M等ASIDAddress Space ID用于TLB区分不同地址空间权限、缓存属性、可共享性设置很多初学者把STE和CD混为一谈其实两者的关系是STE是设备级的CD是地址空间级的。设备能区分多个地址空间时一个STE会对应多个CD不支持SubstreamID时简单场景一个STE对应单个CD即可。2.3 两级翻译stage 1和stage 2到底各干什么这个机制直接对应ARM CPU的虚拟化内存模型对偏软件的读者很关键。stage 1翻译将设备发出的Device Virtual AddressDVA翻译为Intermediate Physical AddressIPA。如果设备运行在虚拟机内部这个IPA就是Guest的物理地址。stage 1的页表一般由Guest操作系统维护和普通CPU用户态地址翻译逻辑非常相似。比如Guest里运行一个进程进程地址空间是0x1000xxxx设备DMA使用该进程的虚拟地址时SMMU stage 1就对该地址做翻译。stage 2翻译将IPA翻译为真正的Physical AddressPA。stage 2的页表由Host或Hypervisor维护用于把Guest的物理内存映射到Host物理内存。Host在给Guest分配内存时通常会为每个Guest建立stage 2页表保证所有DMA都限制在Host允许的物理区域内。两个stage可以同时使能也可以只用一个。比如不带虚拟化但需要地址转换的嵌入式场景可以直接用stage 1做DMA翻译虚拟化设备直通场景则必须两级同时打开。SMMU的设计里stage 1和stage 2的页表属性可以独立配置包括地址大小、颗粒度、内存属性等。2.4 翻译流程演算一个DMA请求走完全程为了把流程说透拿一个具体例子推演一遍。假设一台ARM服务器上QEMU/KVM把一块NVMe控制器直通给Guest。Guest里的NVMe驱动要把一块数据从Guest物理内存IPA0x10000读进设备缓冲区它配置NVMe控制器DMA目标地址为0x10000并设置PASID指向进程地址空间0x7f000000。数据流是这样的NVMe控制器发出AXI读请求地址为0x7f000000请求头带SIDPASID某值。总线事务到达SMMU后SMMU先用SID查Stream Table找到对应的STE。STE使能了stage 1和stage 2。SMMU先做stage 1翻译用0x7f000000走stage 1页表得到IPA0x10000。这里stage 1页表就是Guest内核的进程页表。SMMU继续做stage 2翻译用IPA0x10000走stage 2页表得到PA0x800010000假设Host分配的物理页在4GB以上高位。SMMU把最终PA用于访问内存DMA数据直接写入0x800010000对应的物理内存页也就是Guest看到的那块IPA0x10000的区域。如果只有stage 1那就是芯片设计或者裸机场景设备DMA直接使用IPA或VASMMU翻译后得到PA如果只有stage 2那就是Hypervisor只做内存隔离不做客户机内部地址翻译某些场景下性能和复杂度都会低一些但灵活性也差。整个过程里SMMU的TCU会查TLBTLB内部条目分别带stage 1和stage 2的标签。ARM SMMUv3允许两个stage的TLB条目合并成Combined TLB entry进一步降低查找开销。2.5 三种操作模式翻译、bypass、abortSMMU对每个DMA请求最终执行结果有三种翻译Translate、旁路Bypass、终止Abort。bypass模式表示不翻译DMA地址直通物理地址。这种模式一般用于启动早期、固件阶段、或者明确不需要地址转换的设备。注意bypass不等于没有隔离它在安全场景下就失效了。如果SMMU被配置为bypass但某个内存区域是安全内存没有权限的设备访问还是会触发错误。abort模式则直接拒绝该DMA并向系统报告错误。v3的实现方式是通过事件队列Event Queue产生一条事件记录软件可以看到具体是什么地址、什么SID、什么原因导致中止。Linux内核的IOMMU框架会把这种中止记账到iommu fault统计里用户态通过vfio的eventfd也可能收到信号。这里有一个容易踩坑的点很多SoC默认SMMU处于bypass状态或者全局默认属性是bypass这在开发早期很省事但也带来安全风险。真实产品上线前一定要把非必要的设备切到abort或翻译模式否则一块没配SMMU的设备可能会访问到系统任意内存。2.6 缓存结构与SMMU性能坑SMMU的性能关键在缓存。SMMUv3里缓存分成多个层次和类型TLBs保存VA到IPA、IPA到PA的翻译结果。核心的翻译缓存。Config Cache缓存STE/CD解析结果避免每个请求都翻内存里的Stream Table。类似CPU的页表快表。Context Cache缓存stage 1上下文信息配合SubstreamID使用。还有命中原语Hit under Miss和多级队列等高性能特性。实际调优中最常遇到的问题是设备DMA表现差查下来是SMMU TLB Miss率太高。常见原因有这几个一是页表粒度太大或太小不匹配设备访问模式。比如NVMe驱动通常做4K块IO如果你的stage 2页表用了2MB的大页但IOVA分配没有对齐2MB没有归并成大页那TLB就cover不了连续IOmiss率飙升。二是IOVA分配器碎片化。内核的IOMMU框架分配IOVA时如果频繁分配和释放IOVA空间碎片严重导致同一个设备DMA的区域不连续TLB无法合并。三是不必要的Stage切换。某些场景SMMU可以配置两级翻译合并成组合缓存条目但两个stage的页表属性差异过大时合并效率低。解决方案通常包括调整DMA分配策略尽量从高地址分配、按大页对齐使用iommupt或者SMMU的bypass策略做性能回归对照如果只是需要连续性不关心安全隔离可以考虑把SMMU配置为passthrough模式但必须评估风险。3. 实操过程Linux内核中SMMU的初始化与配置3.1 设备树中怎么描述SMMU无论是ARMv8服务器还是嵌入式平台Linux内核用设备树DT来描述SMMU硬件。以arm,smmu-v3为例一个典型的节点长这样smmu0: iommu8000000 { compatible arm,smmu-v3; reg 0x0 0x8000000 0x0 0x40000; interrupts GIC_SPI 123 IRQ_TYPE_EDGE_RISING, GIC_SPI 124 IRQ_TYPE_EDGE_RISING, GIC_SPI 125 IRQ_TYPE_EDGE_RISING, GIC_SPI 126 IRQ_TYPE_EDGE_RISING; #iommu-cells 1; dma-coherent; };interrupts在SMMUv3里通常是4个中断命令队列消费中断、事件队列中断、优先级队列中断以及可能的内存中断比如在GIC ITS中的MSI。不同平台可能只实现部分中断可以在DT里只定义一个事件队列中断但驱动通常要求至少有event queue中断否则就只能polling。#iommu-cells 1表示外设引用这个SMMU时会给1个参数一般就是StreamID或者高16位是SID、低16位是mask之类的和平台相关含义。配套的PCIe host桥节点里要有iommu-map来建立RID到SMMU的映射pcie0: pcie40000000 { reg 0x0 0x40000000 0x0 0x10000000; bus-range 0x0 0xff; ranges 0x82000000 0x0 0x60000000 0x0 0x60000000 0x0 0x20000000; #address-cells 3; #size-cells 2; iommu-map 0x0 smmu0 0x0 0x10000; };这里iommu-map四元组的意思是第一个字段是PCIe RID起始值第二个是phandle指向SMMU第三个是SMMU侧的StreamID起始值第四个是映射范围。PCIe RID是16位所以0x10000正好映射全部RID空间。学习这块时最容易困惑的是为什么PCIe的RID要映射成SMMU的StreamID而不是直接用RID。因为不同SoC的SMMU接口协议不一样StreamID位数、编码规则可能和PCIe RID不一致所以通过iommu-map灵活映射。3.2 arm-smmu-v3驱动的初始化流程Linux内核的drivers/iommu/arm/arm-smmu-v3.c实现SMMUv3驱动初始化流程大致如下probe函数检查硬件版本读取SMMU_IDR0、SMMU_IDR1等寄存器判断支持的特性是否支持stage 1、stage 2、是否支持compound、支持多少StreamID位、队列中断方式等。配置全局寄存器SMMU_GBPAGlobal Bypass and Permission Attributes初始值一般是bypass或abort这取决于平台启动需求。初始化命令队列CMD Queue。驱动分配一块内存做命令队列SMMU通过写命令来操作TLB失效、设置STE等。命令队列必须按ARM ARM规定的方式初始化先写BASE然后写PROD生产者再更新CONS消费者确保SMMU能正确读写。分配和初始化Stream Table。根据支持的StreamID位宽决定Stream Table大小。SMMUv3的Stream Table有两种格式线性表和两级表。线性表简单但SID位数多时太耗内存两级表适合SID位宽大的场景。注册iommu_ops接入Linux IOMMU框架。对每个接入的设备调用add_device回调从设备树或ACPI中获取StreamID设置STE为默认状态一般是abort或bypass取决于软件策略。这里有个实践要点驱动初始化早期Stream Table大小和形态的选择会影响内存占用。假设SoC支持20位StreamID线性表每个STE 64字节那么一个线性表就是64MB显然不能随便用线性表。这时候应该使用两级表L1本身小根据实际接入的SID只映射实际有设备的那部分L2页极大降低内存占用。3.3 从驱动侧给设备配置DMA映射的正确姿势以Linux驱动的角度如果你写一个普通设备驱动要使用SMMU通常不需要直接操作SMMU硬件而是用DMA API或IOMMU API。最常用的方式/* 分配DMA缓冲区 */ dma_addr_t dma_handle; void *cpu_addr dma_alloc_coherent(dev, size, dma_handle, GFP_KERNEL); /* 映射一个已存在的内核缓冲区 */ dma_addr_t dma_addr dma_map_single(dev, cpu_vaddr, size, DMA_TO_DEVICE); dma_unmap_single(dev, dma_addr, size, DMA_TO_DEVICE);使用dma_alloc_coherent时内核会通过IOMMU框架为这块内存分配IOVASMMU里就自动建立好了DMA地址到物理地址的映射。不需要驱动开发人员手动去写STE页表框架全包了。但如果你做的是VDPAvDPA、SPDK用户态驱动、或者自己实现用户态IOMMU控制就可能需要绕过内核DMA API直接操作IOMMU。这种情况下就需要学习iommu_map、iommu_domain_alloc等接口。最常见的例子SPDK用vfio来管理NVMe设备本质是把SMMU的DMA映射能力暴露给用户态用户在用户态构造IOVA映射表vfio通过ioctl下发。这个流程底层就涉及SMMU页表的新建和销毁。3.4 QEMU/KVM设备直通时的SMMU配置实践虚拟化是SMMU的重要应用场景单独拿出来讲。在QEMU/KVM里做设备直通device passthrough一般步骤是将物理设备从Host驱动解绑绑定到vfio-pci驱动。查看设备所属的iommu_group确认设备可以被安全隔离。将设备通过VFIO设备节点传给QEMU。QEMU侧设置-device vfio-pci,host0000:01:00.0。物理SMMU如何处理直通设备的DMA这里要理解的是当设备直通给Guest后Guest里的驱动操作设备发起DMADMA经过物理SMMU。SMMU的stage 2页表由Host QEMU设置实现Guest IPA到Host PA的映射。本质上和CPU侧KVM的stage 2是类似的。关键点来了Guest内部如果也有SMMU虚拟SMMU还是物理SMMU直接暴露这个问题分两种情况如果Host只是做直通不把物理SMMU暴露给Guest那么Guest里看不到SMMU设备Guest IOMMU驱动不加载Guest的设备驱动看到的DMA地址直接就是Guest物理地址IPA底层由物理SMMU的stage 2完成翻译。如果使用SMMU虚拟化扩展如SMMUv3的Nesting支持可以把物理SMMU的stage 1留给Guest管理stage 2由Host管理。这种模式叫Nested Translation性能更好但实现复杂需要QEMU/KVM和SMMU驱动配合。实际部署中大多数云厂商虚拟机直通设备时Guest不会直接管理物理SMMU而是由Host侧统一配置stage 2Guest内部如果开启了IOMMU比如vfio inside guest它实际上操作的是一个虚拟SMMU或纯软件模拟的IOMMU。这里很考验对两级翻译的理解。我在项目中曾经遇到过一个问题Guest里的DPDK应用通过vfio直通物理网卡直通后吞吐只有预期的30%。排查下来发现是Host侧SMMU的TLB Miss率极高原因是vCPU和DMA访问的内存页面分布太散。解决方法是调整QEMU物理内存分配策略让Guest的大块内存尽量映射到Host的大页同时把Host的IOMMU配置为使用2MB大页映射吞吐从30%恢复到了90%左右。3.5 从PCIe ATS/PRI看SMMU的新玩法SMMUv3还支持PCIe ATSAddress Translation Services和PRIPage Request Interface这两个特性对性能优化意义重大。ATS允许PCIe设备在发起DMA之前主动向SMMU查询地址翻译并把翻译结果缓存在设备内部。这样DMA真正发起时地址已经翻译好了SMMU只需要验证并查缓存延迟大大降低。这对高速网卡、NVMe SSD特别有用。PRI则是设备向SMMU发出页请求。当设备发起DMA遇到页错误时支持PRI的设备可以发送一个page request消息给SMMUSMMU通过PRI Queue把消息转发给软件。软件例如Linux的IOMMU驱动解析fault、按需分配页并映射然后通过Response消息通知设备可以重试DMA。这为SVA和用户态页错误处理提供了机制。使用PRI的时候有两点要特别注意第一PRI Queue必须配置好足够深度否则大量设备同时发Page Request时队列溢出会造成关键请求丢失。第二设备必须先启用ATS才能使用PRI。因为PRI基于ATS协议的消息格式。Linux内核的IOMMU框架如果探测到设备支持PRI会通过iommu_sva_bind_device之类的接口把页请求回调注册到驱动侧。4. 常见问题与排查技巧实录4.1 SMMU Event Queue报错怎么读用SMMU最常碰到的就是Event Queue里出现fault记录。SMMUv3的事件记录是128位16字节格式如下第0~31位还原的DMA地址或发起请求的地址第32~47位StreamID第48~63位SubstreamID如果支持第64~79位一些原因代码比如访问权限、翻译错误等Linux内核里可以用以下命令查看cat /sys/kernel/debug/iommu/arm-smmu-v3/events或者看内核日志通常会有类似这样的输出arm-smmu-v3 8000000.iommu: event 0x01 received: arm-smmu-v3 8000000.iommu: addr0x00000000deadbeef arm-smmu-v3 8000000.iommu: sid0x0000 arm-smmu-v3 8000000.iommu: reason0x02 (translation fault)reason为0x02就是翻译错误说明设备发出的DMA地址在对应页表里没有映射或者没有权限。遇到这种情况优先检查设备的驱动是否正确调用了dma_map接口或者设备树的iommu-map是否配置正确。0x04是权限错误比如只读页收到写请求。0x11是STE配置错误比如STE没有初始化或指向了非法地址。不同厂商的SMMU实现reason编码可能略有差异以ARM SMMUv3架构手册为准。排查时最实用的步骤确认fault地址对应的是哪个进程或哪段内存可以用cat /proc/iomem以及IOMMU debugfs来交叉验证。确认SID是否对应到你预期的设备。如果SID是0但设备不是总线上的第一个设备那大概率是iommu-map没配好。确认页表权限位是否正确。比如设备想写而页表PTE的AP位写保护了就会报权限错误。4.2 启动阶段DMA fault的经典场景嵌入式平台上U-Boot阶段外设初始化时SMMU可能还没被Linux接管。某些设备在U-Boot完成后仍然处于DMA活跃状态比如网卡还在收包。当Linux内核启动SMMU驱动初始化SMMU并默认把StreamTable设为abort时这些还没被管理的设备发DMA直接abort。这个场景的经典现象是Linux启动早期在SMMU驱动probe附近出现一堆event fault系统可能卡死也可能只是打印日志。解决思路是确保在Linux接管SMMU前U-Boot已经停止了所有外设DMA或者将这些设备配置为bypass模式。也可以用arm-smmu-v3.disable_bypass1之类的内核参数让SMMU初始化后所有没有明确配置的设备都abort从安全角度是好事不过启动阶段没有驱动绑定的设备也容易出问题。还有一种情况是Linux启动早期IOMMU框架还未初始化完成DMA已经在飞可以在设备树中给关键设备配dma-coherent、iommupt等方式缓解但记住这只能解决一时的问题。4.3 为什么DMA地址是IOVA不是物理地址很多驱动开发者在调试时都会困惑为什么dma_alloc_coherent返回的dma_addr和设备直接写DMA寄存器时看到的地址和内核log里的物理地址对不上这就是IOVA。DMA API分配的dma_addr是IOVASMMU页表负责把它翻译成物理地址。如果你用/proc/iomem去对应会觉得地址对不上这是正常的。如果遇到设备DMA看起来“没工作”的情况第一件事就是验证IOVA和PA的映射关系。Linux里可以查看IOMMU debugfs的映射表cat /sys/kernel/debug/iommu/arm-smmu-v3/domains cat /sys/kernel/debug/iommu/arm-smmu-v3/mappings如果映射表里没有你要找的IOVA说明你的设备没有真正建立DMA映射DMA不会成功。另一个常见问题设备驱动在中断上下文里调用dma_map_single。DMA API设计允许原子上下文但IOMMU映射可能会分配内存这在原子上下文是危险的。解决办法是提前把DMA buffer分配好、映射好中断里只用现成的dma_addr。4.4 性能问题为什么DMA吞吐上不去SMMU相关的性能瓶颈通过perf工具或SMMU的PMUPerformance Monitoring Unit可以定位。SMMUv3的PMU可以统计TLB访问次数、命中次数页表walk次数事件队列溢出次数地址翻译耗时分布用perf查看PMU事件的例子perf stat -e arm_smmuv3_pmu/event0x01/ sleep 1如果你发现TLB miss率很高尝试以下方向改用大页映射。在IOMMU框架里大页支持取决于页表格式SMMUv3支持最大16MB的页如果实现但IOVA分配时也要对齐。调整IOVA分配器。Linux IOMMU框架默认有IOVA缓存如果缓存太小或者频繁耗尽也会导致性能波动。如果设备频繁做小的分散DMA考虑在驱动里做bounce buffer合并。比如网络驱动的多段skb尽量聚合成一个大DMA映射。检查是否开了SMMU的低功耗模式或电源管理状态某些平台在DMA活跃时SMMU自动进入低功耗恢复时带来了额外时延。另外提醒一下arm-smmu-v3驱动在初始化时如果检测到设备支持ATS会开启ATS。开启之后设备会缓存地址翻译如果设备端的TLB容量小反而可能没有收益。实测中有些网卡在ATS开启后性能还不如不开启这是因为每个DMA都要先发ATS翻译请求增加了额外的消息开销。可以用enable_ats0模块参数关掉ATS做对照实验。4.5 二级翻译与Guest perf的坑虚拟化设备直通场景中二级翻译stage 2的性能损耗往往比预想大。原因主要是每次TLB miss都要做两次页表walk。stage 1 miss先walk一级拿到IPA后再walk stage 2两次访问都上内存时延高。两级TLB的容量可能互相挤压造成缓存利用率下降。解决方向确保Host侧使用透明大页THP这样stage 2的页表可能是2MB大页walk次数大幅减少。在QEMU侧考虑使用VFIO的IOMMU nesting接口。通过VFIO_IOMMU_TYPE1_NESTING_IOMMU可以让Guest直接管理stage 1Host只管理stage 2减少重复walk的开销。使用SMMUv3的SMMU_CR0.SMMUEN及时刷新配置在创建domain时尽量使用iommu_domain_allocIOMMU_DOMAIN_NESTED来建立嵌套映射。还要特别注意Host侧IOMMU SVA和VFIO共享底层硬件时它们使用不同的地址空间但共享同一个SMMU实例。某些SMMU实现里Context Cache容量有限SVA和VFIO的上下文互相冲突。这种问题很难查现象是性能不稳定有时好用有时不好用。经验做法是固定保留几个Context给SVA其他给VFIO看SMMU的IDR寄存器确认支持的CD数量。4.6 安全属性配置中的身份切换ARM体系里设备访问内存还可以带安全/非安全属性。SMMU自身也有安全状态Secure SMMU和非安全SMMU。Secure world可以通过配置Stall/Abort等行为控制非安全设备的DMA访问。实际项目中在高安全要求场景比如可信执行环境TEE需要确保某些安全内存区域不允许非安全设备DMA访问。做法一般是在SMMU页表PTE中设置安全属性位标记该区域为安全内存。非安全设备的stream配置里不带安全权限SMMU检查不通过直接abort。通过SCMI或SMCCC固件接口将某些SMMU寄存器锁定防止Non-secure软件篡改。这种属性配置一旦写错就会造成安全漏洞。所以我建议在固件阶段就定义好全局访问策略默认abort只对授权设备开放bypass或翻译不要图方便默认全部bypass。顺便提一句SMMU和TrustZone的配合很紧密。ARMv8/v9平台上SMMU的安全能力是TEE落地的关键一环如果做安全固件光学会驱动配置是不够的还需要理解SMMU的secure stream table和isolation概念。5. 工具选型与调试手段5.1 内核参数快速控制调试SMMU相关问题时内核参数能帮大忙iommu.passthrough1让IOMMU在可能的情况下走passthrough跳过翻译用于性能回归测试确认是不是SMMU瓶颈。arm-smmu-v3.disable_bypass1SMMU初始化后对所有没有配置的stream一律abort加强安全。iommu.strict0允许IOMMU lazy unmapping也就是延迟释放TLB映射有时能显著提升高频DMA映射场景性能。iommu.forcedac1允许64位DMA地址如果设备支持可以扩大DMA地址空间减少IOVA压力。不过这些参数不能盲目开要理解背后的效果。比如passthrough模式下SMMU基本不做地址翻译设备直接访问物理地址如果系统有多个Guest且共享设备隔离性就没了。5.2 Linux内核IOMMU框架接口一图流如果你想在内核驱动里手动操作SMMU核心接口如下struct iommu_domain *domain iommu_domain_alloc(bus); iommu_attach_device(domain, dev); iommu_map(domain, iova, phys, size, prot); iommu_unmap(domain, iova, size); iommu_detach_device(domain, dev); iommu_domain_free(domain);注意iommu_map的iova和phys都需要页对齐size也必须是页的整数倍。如果你要映射一块非连续的内存需要多次调用iommu_map。批量映射时注意性能尽量按大页对齐。在用户态使用vfio时接口对应的是struct vfio_iommu_type1_dma_map dma_map { .argsz sizeof(dma_map), .flags VFIO_DMA_MAP_FLAG_READ | VFIO_DMA_MAP_FLAG_WRITE, .vaddr (__u64)buf, .iova iova, .size size, }; ioctl(container_fd, VFIO_IOMMU_MAP_DMA, dma_map);这套接口背后都到了SMMU驱动。5.3 用QEMU模拟SMMU做开发和验证如果你手上没有硬件QEMU也可以模拟ARM SMMUv3。QEMU中ARM virt平台支持-device arm-smmuv3qemu-system-aarch64 -machine virt,gic-version3,iommusmmuv3 \ -cpu cortex-a72 -smp 4 -m 2G \ -kernel Image \ -initrd initrd.img \ -append consolettyAMA0 iommu.passthrough0这样可以把驱动开发和故障排查大部分工作放到没有硬件的环境下完成。QEMU对SMMUv3的模拟比较完整支持command queue、event queue、stage 1/stage 2、STE以及基本的ATS/PRI模拟。做过这套模拟之后再去真机上调试会顺很多。我自己的习惯是先在QEMU里跑通IOMMU框架的映射和fault流程再用ARM fast model或者真实开发板做功耗和性能验证。QEMU虽然速度慢但胜在可控、可打印、可重复。6. 一些个人实战感悟从SMMUv2到SMMUv3从嵌入式RTOS到数据中心高性能网卡我陆陆续续调了不少SMMU相关的问题。最大的体会是SMMU的问题通常不是SMMU本身的问题而是周围系统集成的问题。地址没对上、中断没配好、StreamID映射错、共享内存属性不匹配这些占了绝大多数。所以学习SMMU一定不要只盯着寄存器手册要把它放到完整的SoC拓扑里去理解设备端的总线标识怎么来设备树里怎么描述IOMMU框架怎么管理domain虚拟化层怎么设计stage 2安全固件怎么设置全局默认属性这一条链路走通才算真正掌握。最后分享一个小技巧如果你在新平台Bring Up阶段怀疑SMMU配置出错最快的方法是先在完全bypass的SMMU配置下把基础驱动跑通然后逐步打开SMMU翻译每次只开一个stage配一台设备看event queue。这个“增量式打开”的思路几乎能定位所有SMMU集成问题比一次全开再黑盒调试高效得多。这套方法论也适用于更复杂的安全启动、多虚拟机直通场景。希望这篇文章能帮你在SMMU这条不浅的河里少呛几口水。

ARMv8/v9 SMMU系统架构解析：从DMA地址翻译到虚拟化实践

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